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【2h】

Multiplexed oversampling digitizer in 65 nm CMOS for column-parallel CCD readout

机译：用于列并行CCD读数的65 nm CMOS中的多路复用过采样数字转换器

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Carl R. Grace; Jean-Pierre Walder; Henrik von der Lippe;
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年度 2011
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1. Multiplexed Oversampling Digitizer in 65 nm CMOS for Column-Parallel CCD Readout [J] . Grace C.R., Walder J., Denes P., Nuclear Science, IEEE Transactions on . 2013,第1期

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3. A 7 mW 20 MHz BW Time-Encoding Oversampling Converter Implemented in a 0.08 mm$^{2}$ 65 nm CMOS Circuit [J] . Prefasi E., Paton S., Hernandez L. Solid-State Circuits, IEEE Journal of . 2011,第7期

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4. Multiplexed oversampling digitizer in 65 nm CMOS for column-parallel CCD readout [C] . Grace, Carl R., Walder, Jean-Pierre, von der Lippe, Henrik Nuclear Science Symposium and Medical Imaging Conference (NSS/MIC), 2011 IEEE . 2011

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