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【2h】

A 20GHz variability-aware robust, high-speed and low-power MOS CML latch

机译：一个20GHz可变性感知的鲁棒，高速和低功耗MOS CML锁存器

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Minjae Lee;
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年度 2012
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1. A 20GHz variability-aware robust, high-speed and low-power MOS CML latch [J] . Minjae Lee IEICE Electronics Express . 2012,第14期

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2. Low-power high-speed CMOS double tail dynamic comparator using self-biased amplification stage and novel latch stage [J] . Dubey Avaneesh K., Nagaria R. K. Analog Integrated Circuits and Signal Processing . 2019,第2期

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3. A novel low-power, low-offset, and high-speed CMOS dynamic latched comparator [J] . HeungJun Jeon, Yong-Bin Kim Analog Integrated Circuits and Signal Processing . 2012,第3期

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