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机译:用于数字锁相环滤波器设计的模糊逻辑
D. Simon; H. El-Sherief;
机译:基于FPGA的DPLL设计具有应用自定义能力的模糊逻辑控制环路滤波器
机译:锁相环系统中环路滤波器的推导和设计
机译:基于卡尔曼滤波器的观测控制器数字锁相环设计
机译:千兆位速率光接收器和数字锁频环的设计和实现,用于基于锁相环的应用。
机译:具有延迟耦合的数字锁相环的自组织同步理论与实验
机译:多速率数字滤波器组在宽带全数字锁相环设计中的应用
机译:用于全数字锁相环设计的数字环路滤波器
机译:优化模糊逻辑调节器涉及使用针对至少一个机器操作范围生成的模型来模拟模糊逻辑,该至少一个机器操作范围设置在从逻辑输出到逻辑输入的反馈回路中
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