Effective Algorithm for the Low-Power Set-Associative Cache Memory

机译：低功率集关联高速缓冲存储器的有效算法

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Bo-Sung Jung; Jung-Hoon Lee;
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年度 2014
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1. Parloom: A New Low-Power Set-Associative Instruction Cache Architecture Utilizing Enhanced Counting Bloom Filter and Partial Tags [J] . Sani Sajjad Rostami, Valinataj Mojtaba, Alinezhad Saeideh Journal of circuits, systems and computers . 2019,第12期

机译：Parloom：利用增强的计数布隆过滤器和部分标签的新型低功耗集关联指令缓存体系结构
2. Way-lookup buffer for low-power set-associative cache [J] . Inhwan Lee, Jinku Kang, Sungjae Lee IEICE Electronics Express . 2011,第23期

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3. A 1-V 128-kb four-way set-associative CMOS cache memory usingwordline-oriented tag-compare (WLOTC) structure with thecontent-addressable-memory (CAM) 10-transistor tag cell [J] . Perng-Fei Lin, Kuo J.B. IEEE Journal of Solid-State Circuits . 2001,第4期

机译：一个1-V 128-kb四路集相关CMOS高速缓存存储器，使用面向字线的标签比较（WLOTC）结构和内容可寻址内存（CAM）10晶体管标签单元
4. A 1-V, 3.44-ns, 4.1-mW at 50-MHz, 128-Kb Four-Way Set-Associative CMOS Cache Memory Implemented by 1.8V 0.18μm Foundry CMOS Technology for Low-Voltage Low-Power VLSI System Applications [C] . J. B. Kuo, P. F. Lin, F. Wang, European solid-state circuits conference . 2000

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7. A Behavior-based Adaptive Access-mode for Low-power Set-associative Caches in Embedded Systems [O] . Jiongyao Ye, Hongfeng Ding, Yingtao Hu, 2012

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