机译:用于高数据速率应用的多数逻辑代码迭代解码器的完全并行架构的VHDL设计和FPGA实现
机译:基于多数逻辑码的高数据速率Turbo解码器的VHDL设计和FPGA实现
机译:基于802.11a的OFDM卷积编码器和维特比解码器的FPGA设计与实现
机译:基于FPGA的设计与实现Reed-Solomon编码器和解码器的错误检测和校正
机译:用于Reed-Solomon编码器和解码器的VHDL代码生成器。
机译:基于PWL功能的多涡旋混沌振荡器的FPGA实现的VHDL描述
机译:VHDL在(15,k,d)Reed-solomon码的FpGa上构思和实现