Co-optimizing memory-level parallelism and cache-level parallelism

机译：共同优化内存级并行和缓存级并行性

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Xulong Tang; Mahmut Taylan Kandemir; Mustafa Karakoy; Meenakshi Arunachalam;
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年度 2019
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机译：ASTRO：合成特定于应用程序的可重新配置硬件跟踪以利用内存级并行性
2. Data Layout Transformation Exploiting Memory-Level Parallelism in Structured Grid Many-Core Applications [J] . I-Jui Sung, Nasser Anssari, John A. Stratton, International journal of parallel programming . 2012,第1期

机译：数据布局转换利用结构化网格多核应用程序中的内存级并行性
3. An Analytical Model for a GPU Architecture with Memory-level and Thread-level Parallelism Awareness [J] . Sunpyo Hong, Hyesoon Kim Computer architecture news . 2009,第3期

机译：具有内存级和线程级并行性意识的GPU架构分析模型
4. Impact of Memory-Level Parallelism on the Performance of GPU Coherence Protocols [C] . Francisco Candel, Salvador Petit, Julio Sahuquillo, Euromicro International Conference on Parallel, Distributed, and Network-Based Processing . 2016

机译：内存级并行性对GPU一致性协议性能的影响
5. Efficient Fine-Grain Cooperative Execution of Dynamic Task Parallelism on Heterogeneous Multi/Manycore Systems [D] . Wang, Moyang. 2021

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6. Erratum to: Excessive Parallelism in Protein Evolution of Lake Baikal Amphipod Species Flock [O] . 2021

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7. Modeling Superscalar Processor Memory-Level Parallelism [O] . Sam Van Den Steen, Lieven Eeckhout 2018

机译：建模超卡处理器内存级并行性
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