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【2h】

HALLS: An Energy-Efficient Highly Adaptable Last Level STT-RAM Cache for Multicore Systems

机译：大厅：多核系统的节能高度适应的最后一个STT-RAM缓存

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Kyle Kuan; Tosiron Adegbija;
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年度 2019
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1. HALLS: An Energy-Efficient Highly Adaptable Last Level STT-RAM Cache for Multicore Systems [J] . Kuan Kyle, Adegbija Tosiron IEEE Transactions on Computers . 2019,第11期

机译：霍尔：用于多核系统的高能效，高适应性的最后一级STT-RAM高速缓存
2. Harvesting Row-Buffer Hits via Orchestrated Last-Level Cache and DRAM Scheduling for Heterogeneous Multicore Systems [J] . Song Yang, Alavoine Olivier, Lin Bill ACM Transactions on Design Automation of Electronic Systems . 2019,第1期

机译：通过策划的最后级别缓存和DRAM调度来收集行缓冲区命中，用于异构多核系统
3. On level-1 cache locking for high-performance low-power real-time multicore systems [J] . Abu Asaduzzaman, Vidya R. Suryanarayana, Fadi N. Sibai Computers and Electrical Engineering . 2013,第4期

机译：用于高性能，低功耗实时多核系统的1级缓存锁定
4. Coordinating Prefetching and STT-RAM based Last-level Cache Management for Multicore Systems [C] . Mengjie Mao, Hai (Helen) Li, Alex K. Jones, Proceedings of the ACM international conference of the great lakes symposium on VLSI . 2013

机译：协调多核系统的预取和基于STT-RAM的最后一级缓存管理
5. High Performance and Energy Efficient Shared Hybrid Last Level Cache Architecture in Multicore Systems [D] . Bhosale, Swapnil. 2018

机译：多核系统中高性能和节能共享混合级缓存架构
6. Energy-Efficient Joint Design of Fronthaul and Edge Links for Cache-Aided C-RAN Systems with Wireless Fronthaul [O] . Junbeom Kim, Daesung Yu, Seung-Eun Hong, 2019

机译：具有无线Fronthaul的高速缓存辅助C-RAN系统的Fronthaul和Edge Links的节能关节设计
7. Energy-Efficient Runtime Adaptable L1 STT-RAM Cache Design [O] . Kyle Kuan, Tosiron Adegbija 2020

机译：节能运行时适应性L1 STT-RAM缓存设计
8. Cache Sharing and Isolation Tradeoffs in Multicore Mixed-Criticality Systems. [R] . Chisholm, M., Ward, B. C., Kim, N., 2015

机译：多核混合临界系统中的高速缓存共享和隔离权衡。

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