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机译:汉明码的硬件加速:运行时可重新配置FPGA原型设计
Rohit Jain; Praddumna Deshpande; Pournima Shah;
机译:实现快速ASIP设计空间探索:基于FPGA的运行时可重配置原型器
机译:运行时可重配置FPGA上的硬件/软件分区和流水线调度
机译:使用SMT求解器在运行时可重新配置FPGA的硬件/软件分区和静态任务调度
机译:可重配置平台上的控制算法的硬件-软件协同设计,加速和原型设计
机译:的刚性分子对接码FpGa加速度
机译:使用smT求解器的运行时可重配置FpGa上的硬件/软件分区和静态任务调度*
机译:将FPGA技术与微处理器配合使用以实现可重构的指令级硬件加速的系统
机译:将现场可编程门阵列(FPGA)技术与微处理器结合使用,以实现可重新配置的指令级硬件加速
机译:将现场可编程门阵列(FPGA)技术与微处理机结合使用,以实现可重构的指令级硬件加速
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