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【2h】

Design of Approximate Circuits by Fabrication of False Timing Paths: The Carry Cut-Back Adder

机译：虚假时序路径制造近似电路的设计：携带封面加法器

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Vincent Camus; Mattia Cacciotti; Jeremy Schlachter; Christian Enz;
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年度 2018
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2. Simplified carry save adder-based array multiplier scheme and circuits design [J] . Jia Song, Lyu Shigong, Li Xiayu, International journal of circuit theory and applications . 2015,第9期

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3. Symbolic timing analysis and resynthesis for low power of combinational circuits containing false paths [J] . Bahar R.I., Hyunwoo Cho IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems . 1997,第10期

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4. A low-power carry cut-back approximate adder with fixed-point implementation and floating-point precision [C] . Vincent Camus, Jeremy Schlachter, Christian Enz ACM/EDAC/IEEE Design Automation Conference . 2016

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5. Analysis and Design of High Performance 128-bit Parallel Prefix End-Around-Carry Adder. [D] . Turkyilmaz, Ogun. 2011

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6. Design and Fabrication of a Microfluidic Viscometer Based on Electrofluidic Circuits [O] . Bo-Bi Tzeng, Yung-Shin Sun 2018

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7. A timing-driven synthesis of arithmetic circuits using carry-save-adders [O] . Taewhan Kim, Junhyung Um 2000

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