Low Energy, Low Power Adder Logic Cells: A CMOS VLSI Implementation

机译：低能量，低功耗加法器逻辑单元：CMOS VLSI实现

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S. Hari Hara Subramani; K.S.S.K. Rajesh; V. Elamaran;
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年度 2014
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1. Low Energy, Low Power Adder Logic Cells: A CMOS VLSI Implementation [J] . S. Hari Hara Subramani, K.S.S.K. Rajesh, V. Elamaran Asian Journal of Scientific Research . 2014,第2期

机译：低能耗，低功耗加法器逻辑单元：CMOS VLSI实现
2. Design and Implementation of Low Power 8-bit Carry-look Ahead Adder Using Static CMOS Logic and Adiabatic Logic [J] . Abdul Sajid, Ahmad Nafees, Saifur Rahman International Journal of Information Technology and Computer Science . 2013,第11期

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3. VLSI Implementation of CMOS Full Adders with Low Leakage Power [J] . Manisha B S, Rudraswamy S B International Journal of Computer Network and Information Security . 2018,第4期

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4. 1.5 V CMOS bootstrapped dynamic logic circuit techniques (BDLCT) suitable for low-voltage deep-submicron CMOS VLSI for implementing 482 MHz digital quadrature modulator and adder [C] . Lou, J.H., Kuo, Electronics, Circuits and Systems, 1998 IEEE International Conference on . 1998

机译：适用于低压深亚微米CMOS VLSI的1.5 V CMOS自举动态逻辑电路技术（BDLCT），用于实现482 MHz数字正交调制器和加法器
5. An exploration of ultra-low power arithmetic supply and threshold scaling in CMOS adders. [D] . Depew, Matthew. 2010

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6. Combined Organic Photovoltaic Cells and Ultra Low Power CMOS Circuit for Indoor Light Energy Harvesting [O] . Duarte Batista, Luis Bica Oliveira, Nuno Paulino, 2019

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7. Design and Implementation of Low Power 8-bit Carry-look Ahead Adder Using Static CMOS Logic and Adiabatic Logic [O] . Abdul Sajid, Ahmad Nafees, Saifur Rahman 2013

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