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【2h】

Multi-FPGA Accelerator Architecture for Stencil Computation Exploiting Spacial and Temporal Scalability

机译：用于模板计算的多FPGA加速器架构利用空间和时间可伸缩性

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Hasitha Muthumala Waidyasooriya; Masanori Hariyama;
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年度 2019
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1. Multi-FPGA Accelerator for Scalable Stencil Computation with Constant Memory Bandwidth [J] . Sano K., Hatsuda Y., Yamamoto S. IEEE Transactions on Parallel and Distributed Systems . 2014,第3期

机译：具有恒定存储器带宽的可扩展模板计算的多FPGA加速器
2. PACC: a directive-based programming framework for out-of-core stencil computation on accelerators [J] . Nobuhiro Miki, Fumihiko Ino, Kenichi Hagihara International Journal of High Performance Computing and Networking . 2019,第1期

机译：PACC：基于指令的加速器上的核心模板计算的指令编程框架
3. Exploiting task and data parallelism in ILUPACK's preconditioned CG solver on NUMA architectures and many-core accelerators [J] . Aliaga Jose I., Badia Rosa M., Barreda Maria, Parallel Computing . 2016,第May期

机译：在NUMA架构和多核加速器上的ILUPACK预处理CG解算器中利用任务和数据并行性
4. Exploiting Computation Reuse for Stencil Accelerators [C] . Yuze Chi, Jason Cong ACM/IEEE Design Automation Conference . 2020

机译：利用模板加速器的计算重用
5. Performance Optimization of Stencil Computations on Modern SIMD Architectures. [D] . Henretty, Thomas Steel. 2014

机译：现代SIMD架构上的模板计算性能优化。
6. DeepDynamicHand: A Deep Neural Architecture for Labeling Hand Manipulation Strategies in Video Sources Exploiting Temporal Information [O] . Visar Arapi, Cosimo Della Santina, Davide Bacciu, 2018

机译：DeepDynamicHand：用于在利用时间信息的视频源中标注手操纵策略的深度神经体系结构
7. Exploiting multi-scale parallelism for large scale numerical modelling of laser wakefield accelerators [O] . Fonseca, Ricardo A., Vieira, Jorge, Fiúza, Frederico, 2013

机译：利用多尺度并行机制进行大规模数值模拟激光尾场加速器

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