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机译:高速添加剂的高速数字设计块设计
Deepa Yagain; Vijaya Krishna A; Akansha Baliga;
机译:使用完整加法器和基于可逆逻辑的进位跳过块的高效进位跳过加法器设计
机译:使用最小加法器乘法器模块的IIR数字滤波器设计
机译:用于数字电路设计应用的高速并行前缀加法器的设计和分析
机译:高速加法器和阵列乘法器的动态电流模式逻辑电路的分析和设计。
机译:量子点元胞自动机中高效全加器的设计
机译:低功耗高速截断误差加法器的设计及其在数字信号处理中的应用
机译:设计电路系统,扩展现有方法以评估电路设计的可行性,执行电路设计的可行性评估,完善电路设计的第一决策规则,形成电路设计的第二决策规则的方法电路设计,用于为多个预先设计的电路块组织设计者的经验数据,提高胶粘逻辑分配效率,并在设计块之间分配胶粘的多个逻辑元素,并分配胶粘逻辑以在集成电路设备设计中执行方案,转换特定于电路块的接口,选择电路收集器,设计一种包含使能设备测试以验证a正确操作的设备,并开发行为测试台,项圈接口和接口系统
机译:数字传输电路设计支持装置,数字传输电路设计支持程序和数字传输电路设计支持方法
机译:可实现高速住宿设计的路线设计系统和路线设计方法
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