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【2h】

Toward the Design of Fault-Tolerance-and Peak-Power-Aware Multi-Core Mixed-Criticality Systems

机译：朝着容错和峰值功率感知多核混合关键性系统的设计

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作者
Behnaz Ranjbar; Ali Hosseinghorban; Mohammad Salehi; Alireza Ejlali; Akash Kumar;
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年度 2021
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机译：DOL-BIP关键：用于严格的设计和混合关键性多核系统的工具链
2. Real-Time Multiplexing of Mixed-Criticality Data Streams for Automotive Multi-Core Test Systems [J] . Nager Markus, Baunach Marcel, Priller Peter, Intelligent Transportation Systems Magazine, IEEE . 2021,第1期

机译：汽车多核测试系统混合关键数据流的实时复用
3. Optimization of Fault-Tolerant Mixed-Criticality Multi-Core Systems with Enhanced WCRT Analysis [J] . Choi Junchul, Yang Hoeseok, Ha Soonhoi ACM Transactions on Design Automation of Electronic Systems . 2019,第1期

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4. CARP: A Data Communication Mechanism for Multi-core Mixed-Criticality Systems [C] . Anirudh Kaushik, Paulos Tegegn, Zhuanhao Wu, IEEE Real-Time Systems Symposium . 2019

机译：CARP：多核混合关键系统的数据通信机制
5. Design and Optimization of Efficient Power Delivery Systems for Multi-Core Processors. [D] . Wang, Xuan. 2015

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7. DOL-BIP-Critical: a tool chain for rigorous design and implementation of mixed-criticality multi-core systems [O] . Georgia Giannopoulou, Peter Poplavko, Dario Socci, 2018

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