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机译:用于携带的不同技术选择加法器 - 评论
Rajwinder Kaur; Amit Grover;
机译:使用并行前缀加法器进行选择加法器的设计技术,以改善切换能量
机译:利用Bec和可变csla技术设计高效的128位进位选择加法器
机译:使用逻辑优化技术进行携带选择加法器的区域高效VLSI架构的设计
机译:低功耗和优化的纹波进位加法器以及采用MOD-GDI技术的进位选择加法器
机译:高速条件进位选择加法器的仿真与分析。
机译:面积/延迟优化的早期输出异步全加法器和相对定时的纹波进位加法器
机译:采用改进GDI技术的新型高速低功耗进位选择加法器
机译:同时使用提前进位和进位选择技术的加法器
机译:自检全称和自检携带选择加成
机译:自检完整加法器和具有完整加法器的自检进位选择加法器
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