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【2h】

COMPARING BINARY, CSD AND CSD4 APPROACHES ON THE ASPECT OF POWER CONSUMPTION IN FIR FILTERS USING MULTIPLIERLESS ARCHITECTURES ON FPGAS

机译：在FPGA上使用多体系结构的FIR滤波器的功耗方面，二进制，CSD和CSD4方法比较

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作者
Birkeland Guri Kristine;
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年度 2005
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正文语种 eng
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1. Design of FIR Digital Filters with CSD Coefficients Having Power-of-Two DC Gain and Their FPGA Implementation for Minimum Critical Path [J] . Mitsuru Yamada, Akinori Nishihara IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences . 2001,第8期

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2. CSDC: a new complexity reduction technique for multiplierless implementation of digital FIR filters [J] . Yongtao Wang, Roy K. IEEE transactions on circuits and systems . I , Regular papers . 2005,第9期

机译：CSDC：一种新的降低复杂度的技术，用于数字FIR滤波器的无乘法器实现
3. CSDC: A New Complexity Reduction Technique for Multiplierless Implementation of Digital FIR Filters [J] . Yongtao Wang, Kaushik Roy IEEE Transactions on Circuits and Systems. I, Regular Papers . 2005,第9期

机译：CSDC：一种新的降低复杂度的技术，用于数字FIR滤波器的无乘法器实现
4. Low-power multiplierless FIR filter synthesizer based on CSD code [C] . Maw-Ching Liu, Chien-Lung Chen, Ding-Yu Shin . 2001

机译：基于CSD代码的低功耗无乘法器FIR滤波器合成器
5. Multiplierless CSD techniques for high performance FPGA implementation of digital filters. [D] . Wang, Yunhua. 2007

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6. Prophylactic placement of inferior vena cava filters and the risk of death or venous thromboembolism in severe trauma patients: a retrospective study comparing two hospitals with different approaches [O] . Thien Trung Tran, Haraldur Bjarnason, Jennifer McDonald, 2021

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7. A POWERS-OF-TWO TERM ALLOCATION ALGORITHM FOR DESIGNING FIR FILTERS WITH CSD COEFFICIENTS IN A MIN-MAX SENSE [O] . Ito Rika, Fujie Tetsuya, Suyama Kenji, 2004

机译：最小-最大感测中具有CSD系数的FIR滤波器的二项幂分配算法

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