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FehlerratenmeBeinrichtung eineu 640 Mbit/s-PCM-Simulators Error Rate Measuring Equipment of a 640 Mbits/s PCM-Simulator

机译:FehlerratenmeBeinrichtung eineu 640 mbit / s-pCm-simulators 640 mbits / s pCm模拟器的错误率测量设备

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摘要

This paper describes the generation of 4 streams of 160 Ambits/s pseudorandom pulse teat signals and a digital word synchrony-nation method for error rate measurements, which are necessary for an experimental 640 Ambits/s-PCM-transmission system using a waveguide.. Pour delayed versions derived from one 15 stage maximum length sequence with, the aid of mod-2 additions serve as 4 different pseudorandom sources. A simple error rate counting circuit and a resettable counter using shift registers work together a stabilizing circuit which controls the feeding of the clock to a reference pseudorandom pulse generator and achieves word-synchronization.

著录项

  • 作者

    T. Adachi;

  • 作者单位
  • 年度 1972
  • 页码 1-33
  • 总页数 33
  • 原文格式 PDF
  • 正文语种 eng
  • 中图分类 工业技术;
  • 关键词

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