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【24h】

位相差制御によるアナログ位相比較器を用いた△∑変調フラクショナル-NPLLシンセサイザのスプリアス抑圧手法

机译:通过相位差控制使用模拟相位比较器的Δδ调制分数-NPLL合成器的ΔΔ调制分数抑制方法

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摘要

本報告では,アナログ位相比較器を用いた△∑F-PLLシンセサイザのスプリアスを抑圧する新たな手法について報告する.ループフィルタで位相比較器の出力信号に外部より与える設定電圧を加算することで,位相比較器への入力信号の位相差を制御し,この位相差を適当な値とすることでフラクショナル変調に起因するスプリアスを抑圧する.2次MASH形△∑変調器を用いたVHF帯 鳌艶-PLLシンセサイザを試作した結果,最大スプリアスレベルを-33dBcから-48dBcと15dB改善でき,提案する手法の妥当性を確認した.
机译:在本报告中,我们报告了一种使用模拟相位比较器抑制ΔF-PLL合成器的杂种的新方法。 通过在环路滤波器中添加从外部给出的设置电压到相位比较器的输出信号,控制到相位比较器的输入信号的相位差,并且该相位差是由于通过设置相位的分数调制差异很好。抑制了虚假 由于使用二级醪型δ调制器对VHF带 - Shabe-PLL合成器进行原型,可以从-33dBc至-48dBc和15db改善最大杂散水平,并且确认了所提出的方法的有效性。

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