バイパスアーキテクチャ向けコード最適化における演算命令のクラスタリングを利用した改良手法に関する研究

摘要

近年、プロセッサの技術進歩に伴い、消費電力の増加が大きな問題となってきている。消費電力の中でも、プロセッサとレジスタとの通信電力が比較的高い割合を占めている。これを削減するために、バイパス構造をもつアーキテクチャ、及びこのアーキテクチャを効率よく使用するためのDFGを利用したスケジューリング方法が提案されている。本稿では提案されている方法における、DFGの再構成の方法について改良し、再構成中にDFGを分割することにより、スケジューリングにかかる時間を削減する方法について提案する。提案方法を適応することで、バイパスの使用効率の上昇と、スケジューリングにかかる時間の短縮が見込める。