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International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation
International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation
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1.
Low-Power Maximum Magnitude Computation for PAPR Reduction in OFDM Transmitters
机译:
OFDM发射器PAPR减少的低功耗最大幅度计算
作者:
Th. Giannopoulos
;
V. Paliouras
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
2.
Considering Zero-Arrival Time and Block-Arrival Time in Hierarchical Functional Timing Analysis
机译:
考虑分层功能定时分析中的零到达时间和块到达时间
作者:
Daniel Lima Ferrao
;
Ricardo Reis
;
Jose Luis Guentzel
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
3.
Delay Constrained Register Transfer Level Dynamic Power Estimation
机译:
延迟约束寄存器传输水平动态功率估计
作者:
Sriram Sambamurthy
;
Jacob A. Abraham
;
Raghuram S. Tupuri
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
4.
Worst Case Crosstalk Noise Effect Analysis in DSM Circuits by ABCD Modeling
机译:
ABCD建模的DSM电路中最差案例串扰噪声效果分析
作者:
Saihua Lin
;
Huazhong Yang
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
5.
Reducing Energy Dissipation of Wireless Sensor Processors Using Silent-Store-Filtering MoteCache
机译:
使用沉默储存的MoteCache减少无线传感器处理器的能量耗散
作者:
Gurhan Kucuk
;
Can Basaran
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
6.
Estimation of Power Reduction by On-Chip Transmission Line for 45nm Technology
机译:
45NM技术片上传输线估计功率降低
作者:
Kenichi Okada
;
Takumi Uezono
;
Kazuya Masu
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
7.
A Clock Generator Driven by a Unified-CBiCMOS Buffer Driver for High Speed and Low Energy Operation
机译:
由统一CBICMOS缓冲器驱动器驱动的时钟发生器,用于高速和低能量操作
作者:
Toshiro Akino
;
Takashi Hamahata
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
8.
The Power Forward Initiative Charting the Industry’s Course to Achieving Enhanced Power Management Solutions for Advanced Process Geometries
机译:
电力倡议绘制了行业课程,以实现高级工艺几何形状的增强电源管理解决方案
作者:
Francois Thomas
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
9.
Correct Modelling of Nested Miller Compensated Amplifier for Discrete-Time Applications
机译:
嵌套米勒补偿放大器用于离散时间应用的正确建模
作者:
A. Pugliese
;
G. Cappuccino
;
G. Cocorullo
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
10.
Dynamic Management of Thermally-Induced Clock Skew: An Implementation Perspective
机译:
热诱导时钟偏差动态管理:实现视角
作者:
A. Chakraborty
;
K. Duraisami
;
A. Sathanur
;
P. Sithambaram
;
A. Macii
;
E. Macii
;
M. Poncino
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
11.
IR-drop Reduction Through Combinational Circuit Partitioning
机译:
通过组合电路分区IR降低
作者:
Hai Lin
;
Yu Wang
;
Rong Luo
;
Huazhong Yang
;
Hui Wang
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
关键词:
IR-drop;
circuit partitioning;
static timing analysis;
12.
Methodology for Dynamic Power Verification of Contactless Smartcards
机译:
无接触式智能卡的动态功率验证方法
作者:
Mien Mercier
;
Christian Dufaza
;
Mathieu Lisart
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
13.
Impact of Array Data Flow Analysis on the Design of Energy-Efficient Circuits
机译:
阵列数据流分析对节能电路设计的影响
作者:
M. Hillers
;
W. Nebel
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
14.
Statistical Characterization of Library Timing Performance
机译:
图书馆定时性能的统计表征
作者:
V. Migairou
;
R. Wilson
;
S. Engels
;
N. Azemard
;
P. Maurine
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
15.
A CMOS Compatible Charge Recovery Logic Family for Low Supply Voltages
机译:
用于低电源电压的CMOS兼容电荷回收逻辑系列
作者:
Clemens Schlachta
;
Manfred Glesner
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
16.
A Scalable Power Modeling Approach for Embedded Memory Using LIB Format
机译:
使用lib格式的嵌入式内存可扩展功率建模方法
作者:
Wen-Tsan Hsieh
;
Chi-Chia Yu
;
Chien-Nan Jimmy Liu
;
Yi-Fang Chiu
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
17.
Gate-Level Dual-Threshold Static Power Optimization Methodology (GDSPOM) Using Path-Based Static Timing Analysis (STA) Technique
机译:
使用基于路径的静态定时分析(STA)技术的门级双阈值静态功率优化方法(GDSPOM)
作者:
B. Chung
;
J.B. Kuo
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
18.
Two Efficient Synchronous <=> Asynchronous Converters Well-Suited for Network on Chip in GALS Architectures
机译:
两个高效的同步<=>异步转换器适合于GALS架构中芯片网络
作者:
A. Sheibanyrad
;
A. Greiner
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
19.
A Framework for Estimating Peak Power in Gate-Level Circuits
机译:
用于估计栅极电平电路峰值功率的框架
作者:
Diganchal Chakraborty
;
P.P. Chakrabarti
;
Arijit Mondal
;
Pallab Dasgupta
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
20.
A Method for Switching Activity Analysis of VHDL-RTL Combinatorial Circuits
机译:
一种切换VHDL-RTL组合电路活动分析的方法
作者:
Felipe Machado
;
Teresa Riesgo
;
Yago Torroja
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
21.
Software Simultaneous Multi-Threading, a Technique to Exploit Task-Level Parallelism to Improve Instruction- and Data-Level Parallelism
机译:
软件同步多线程,一种用于开发任务级并行性的技术,以提高指令和数据级并行性
作者:
Daniele Paolo Scarpazza
;
Praveen Raghavan
;
David Novo
;
Francky Catthoor
;
Diederik Verkest
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
22.
Circuit Design Style for Energy Efficiency: LSDL and Compound Domino
机译:
电路设计风格的能效:LSDL和复合多米诺
作者:
Xiao Yan Yu
;
Robert Montoye
;
Kevin Nowka
;
Bart Zeydel
;
Vojin Oklobdzija
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
23.
Circuit Sizing and Supply-Voltage Selection for Low-Power Digital Circuit Design
机译:
低功耗数字电路设计的电路尺寸和电源电压选择
作者:
Milena Vratonjic
;
Bart R. Zeydel
;
Vojin G. Oklobdzija
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
24.
Zephyr: A Static Timing Analyzer Integrated in a Trans-hierarchical Refinement Design Flow
机译:
Zephyr:一个静态时序分析仪,集成在跨层级细化设计流程中
作者:
Christophe Alexandre
;
Marek Sroka
;
Hugo Clement
;
Christian Masson
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
25.
Low Power Distance Measurement Unit for Real-Time Hardware Motion Estimators
机译:
低功率距离测量单元,用于实时硬件运动估算器
作者:
Tiago Dias
;
Nuno Roma
;
Leonel Sousa
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
26.
Low Power and Low Jitter Wideband Clock Synthesizers in CMOS ASICs
机译:
CMOS Asics中的低功耗和低抖动宽带时钟合成器
作者:
Regis Roubadia
;
Sami Ajram
;
Guy Cathebras
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
27.
Handheld System Energy Reduction by OS-Driven Refresh
机译:
OS驱动刷新的手持系统能量减少
作者:
Vasily G. Moshnyaga
;
Hoa Vo
;
Glenn Reinman
;
Miodrag Potkonjak
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
28.
A Novel Methodology to Reduce Leakage Power in CMOS Complementary Circuits
机译:
一种小型方法,以减少CMOS互补电路的漏电
作者:
Preetham Lakshmikanthan
;
Adrian Nunez
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
29.
Asynchronous Design for High-Speed and Low-Power Circuits
机译:
高速和低功耗电路异步设计
作者:
Peter A. Beerel
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
30.
An FPGA Power Aware Design Flow
机译:
FPGA功率感知设计流程
作者:
David Elleouet
;
Yannig Savary
;
Nathalie Julien
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
31.
Hierarchical Modeling of a Fractional Phase Locked Loop
机译:
分数锁相环的分层建模
作者:
Benjamin Nicolle
;
William Tatinian
;
Jean Oudinot
;
Gilles Jacquemod
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
32.
Design of Parallel Implementations by Means of Abstract Dynamic Critical Path Based Profiling of Complex Sequential Algorithms
机译:
基于复杂顺序算法的抽象动态关键路径平行实现设计
作者:
Anatoly Prihozhy
;
Daniel Mlynek
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
33.
Adaptive Coding in Networks-on-Chip: Transition Activity Reduction Versus Power Overhead of the Codec Circuitry
机译:
网络上的自适应编码:转换活动降低与编解码器电路的电源开销
作者:
Jose C.S. Palma
;
Leandro Soares Indrusiak
;
Fernando G. Moraes
;
Alberto Garcia Ortiz
;
Manfred Glesner
;
Ricardo A.L. Reis
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
34.
A Technique to Reduce Static and Dynamic Power of Functional Units in High-Performance Processors
机译:
一种减少高性能处理器功能单元静态和动态功率的技术
作者:
Guadalupe Minana
;
Jose Ignacio Hidalgo
;
Oscar Garnica
;
Juan Lanchares
;
Jose Manuel Colmenar
;
Sonia Lopez
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
35.
The Holy Grail of Holistic Low-Power Design
机译:
整体低功耗设计的圣杯
作者:
F. Pessolano
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
36.
The Design of a Dataflow Coprocessor for Low Power Embedded Hierarchical Processing
机译:
用于低功耗嵌入层次处理的数据流协处理器的设计
作者:
Yijun Liu
;
Steve Furber
;
Zhenkun Li
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
37.
Improving Energy Efficiency Via Speculative Multithreading on MultiCore Processors
机译:
通过在多核处理器上通过推测多线程提高能源效率
作者:
Toshinori Sato
;
Yuu Tanaka
;
Hidenori Sato
;
Toshimasa Funaki
;
Takenori Koushiro
;
Akihiro Chiyonobu
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
38.
Designing Alternative FPGA Implementations Using Spatial Data from Hardware Resources
机译:
使用来自硬件资源的空间数据设计备用FPGA实现
作者:
Kostas Siozios
;
Dimitrios Soudris
;
Antonios Thanailakis
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
39.
Energy-Delay Space Analysis for Clocked Storage Elements Under Process Variations
机译:
过程变化下时钟存储元件的能量延迟空间分析
作者:
Christophe Giacomotto
;
Nikola Nedovic
;
Vojin G. Oklobdzija
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
40.
Heuristic for Two-Level Cache Hierarchy Exploration Considering Energy Consumption and Performance
机译:
考虑能源消耗和性能的两级缓存层次结构启发式探索
作者:
Silva-Filho A.G.
;
Cordeiro F.R.
;
SantAnna R.E.
;
Lima M.E.
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
41.
Low-Power Register File Based on Adiabatic Logic Circuits
机译:
基于绝热逻辑电路的低功耗寄存器文件
作者:
Jianping Hu
;
Hong Li
;
Yangbo Wu
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
42.
A Comparison of Two Approaches Providing Data Encryption and Authentication on a Processor Memory Bus
机译:
在处理器内存总线上提供数据加密和身份验证的两种方法的比较
作者:
Reouven Elbaz
;
Lionel Torres
;
Gilles Sassatelli
;
Pierre Guillemin
;
Michel Bardouillet
;
Albert Martinez
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
43.
A Simple MOSFET Parasitic Capacitance Model and Its Application to Repeater Insertion Technique
机译:
一个简单的MOSFET寄生电容模型及其在中继器插入技术的应用
作者:
Andrea Pugliese
;
Gregorio Cappuccino
;
Giuseppe Cocorullo
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
44.
SRAM CP: A Charge Recycling Design Schema for SRAM
机译:
SRAM CP:SRAM充电回收设计架构
作者:
Ka-Ming Keung
;
Akhilesh Tyagi
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
45.
Leakage Power Characterization Considering Process Variations
机译:
考虑过程变化的泄漏功率表征
作者:
Jose L. Rossello
;
Carol de Benito
;
Sebastia Bota
;
Jaume Segura
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
46.
Static and Dynamic Power Reduction by Architecture Selection
机译:
架构选择静态和动态减少
作者:
Christian Piguet
;
Christian Schuster
;
Jean-Luc Nagel
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
47.
Low Clock Swing D Flip-Flops Design by Using Output Control and MTCMOS
机译:
使用输出控制和MTCMOS低时钟SWING D触发器设计
作者:
Saihua Lin
;
Hongli Gao
;
Huazhong Yang
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
48.
Modeling of Crosstalk Fault in Defective Interconnects
机译:
有缺陷互连串扰故障的建模
作者:
Ajoy K. Palit
;
Kishore K. Duganapalli
;
Walter Anheier
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
关键词:
defect-based-crosstalk fault model;
signal integrity losses;
aggressor-victim;
ABCD-model;
crosstalk-hazards;
49.
Accurate PTV, State, and ABB Aware RTL Blackbox Modeling of Subthreshold, Gate, and PN-Junction Leakage
机译:
准确的PTV,状态和ABB认识RTL Blackbox建模的亚阈值,门和PN结漏
作者:
Domenik Helms
;
Marko Hoyer
;
Wolfgang Nebel
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
50.
High Performance CMOS Circuit by Using Charge Recycling Active Body-Bias Controlled SOI
机译:
高性能CMOS电路通过使用电荷回收活性体偏置控制SOI
作者:
Masayuki Kitamura
;
Masaaki Iijima
;
Kenji Hamada
;
Masahiro Numa
;
Hiromi Notani
;
Akira Tada
;
Shigeto Maegawa
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
51.
Optimization of Master-Slave Flip-Flops for High-Performance Applications
机译:
高性能应用的主机触发器优化
作者:
Raul Jimenez
;
Pilar Parra
;
Javier Castro
;
Manuel Sanchez
;
Antonio Acosta
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
52.
New Battery Status Checking Method for Implantable Biomedical Applications
机译:
用于植入生物医学应用的新电池状态检查方法
作者:
Jong-pil Son
;
Kyu-young Kim
;
Ji-yong Jeong
;
Yogendera Kumar
;
Soo-won Kim
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
53.
Exploiting Narrow Values for Energy Efficiency in the Register Files of Superscalar Microprocessors
机译:
利用超卡微处理器的注册文件中的能效的窄值
作者:
Oguz Ergin
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
54.
Sensitivity of a Power Supply Damping Method to Resistance and Current Waveform Variations
机译:
电源阻尼方法对电阻和电流波形变化的敏感性
作者:
Juergen Rauscher
;
Hans-Joerg Pfleiderer
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
55.
Nanoelectronics: Challenges and Opportunities
机译:
纳米电子学:挑战和机遇
作者:
Giovanni De Micheli
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
56.
Design for Volume Manufacturing in the Deep Submicron ERA
机译:
深度亚微米时代的体积制造设计
作者:
Robin Wilson
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
57.
Techniques to Enhance the Resistance of Precharged Busses to Differential Power Analysis
机译:
提高预充电总线对差分功率分析的电阻的技术
作者:
M. Alioto
;
M. Poli
;
S. Rocchi
;
V. Vignoli
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
58.
Body Bias Generator for Leakage Power Reduction of Low-Voltage Digital Logic Circuits
机译:
用于低压数字逻辑电路漏功率降低的车身偏置发生器
作者:
Ji-Yong Jeong
;
Gil-Su Kim
;
Jong-Pil Son
;
Woo-Jin Rim
;
Soo-Won Kim
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
59.
Low-Power Adaptive Bias Amplifier for a Large Supply-Range Linear Voltage Regulator
机译:
用于大型电源线性电压调节器的低功耗自适应偏置放大器
作者:
Stefan Cserveny
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
60.
Formal Evaluation of the Robustness of Dual-Rail Logic Against DPA Attacks
机译:
对DPA攻击双轨逻辑鲁棒性的正式评价
作者:
Alin Razafindraibe
;
Michel Robert
;
Philippe Maurine
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
|
2006年
61.
Compiler-Driven Leakage Energy Reduction in Banked Register Files
机译:
银行寄存器文件中的编译器驱动泄漏能量减少
作者:
David Atienza
;
Praveen Raghavan
;
Jose L. Ayala
;
Giovanni De Micheli
;
Francky Catthoor
;
Diederik Verkest
;
Marisa Lopez-Vallejo
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
62.
Top Verification of Low Power System with “Checkerboard” Approach
机译:
具有“棋盘”方法的低功率系统的热门验证
作者:
Jean Oudinot
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
63.
Power Modeling of a NoC Based Design for High Speed Telecommunication Systems
机译:
基于NOC的高速电信系统设计功率建模
作者:
Philippe Grosse
;
Yves Durand
;
Paul Feautrier
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
64.
System Level Multi-bank Main Memory Configuration for Energy Reduction
机译:
系统级多银行主内存配置,用于能量减少
作者:
Hanene Ben Fradj
;
Cecile Belleudy
;
Michel Auguin
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
65.
Partial Bus-Invert Bus Encoding Schemes for Low-Power DSP Systems Considering Inter-wire Capacitance
机译:
考虑线间电容的低功耗DSP系统部分总线 - 反转总线编码方案
作者:
T. Murgan
;
P.B. Bacinschi
;
A. Garcia Ortiz
;
M. Glesner
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
66.
Receiver Modeling for Static Functional Crosstalk Analysis
机译:
静态功能性串扰分析的接收机建模
作者:
Mini Nanua
;
David Blaauw
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
67.
Power Modeling of Precharged Address Bus and Application to Multi-bit DPA Attacks to DES Algorithm
机译:
预充电地址总线的功率建模和应用于DES算法的多位DPA攻击
作者:
M. Alioto
;
M. Poli
;
S. Rocchi
;
V. Vignoli
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
68.
Spectral Analysis of the On-Chip Waveforms to Generate Guidelines for EMC-Aware Design
机译:
片上波形的光谱分析,以生成EMC感知设计的准则
作者:
Davide Pandini
;
Guido A. Repetto
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
69.
QDI Latches Characteristics and Asynchronous Linear-Pipeline Performance Analysis
机译:
QDI锁存特性和异步线性管道性能分析
作者:
Eslam Yahya
;
Marc Renaudin
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
70.
Methodology for Energy-Efficient Digital Circuit Sizing: Important Issues and Design Limitations
机译:
节能数字电路尺寸的方法:重要问题和设计限制
作者:
Bart R. Zeydel
;
Vojin G. Oklobdzija
会议名称:
《International Workshop on Integrated Circuit and System Design: Power and Timing Modeling, Optimization and Simulation》
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2006年
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