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>
IEEE Symposium on Low-Power and High-Speed Chips
IEEE Symposium on Low-Power and High-Speed Chips
召开年:
2014
召开地:
Yokohama(JP)
出版时间:
-
会议文集:
-
会议论文
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1.
Front cover
机译:
封面
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
2.
Message from the advisory committee chair
机译:
咨询委员会主席的话
作者:
Nakamura Tadao
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
3.
Supporting organization
机译:
支持组织
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
4.
Front matters
机译:
前线事项
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
5.
Establishing a standard interface between multi-manycore and software tools - SHIM
机译:
在多核和软件工具之间建立标准接口-SHIM
作者:
Gondo Masaki
;
Arakawa Fumio
;
Edahiro Masato
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
6.
Parallel design of control systems utilizing dead time for embedded multicore processors
机译:
利用死区时间的嵌入式多核处理器的控制系统并行设计
作者:
Suzuki Yuta
;
Sata Kota
;
Kako Junichi
;
Yamaguchi Kohei
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
control system;
dead time;
model based design;
multicore;
parallelization;
7.
Language runtime support for NVM/DRAM hybrid main memory
机译:
对NVM / DRAM混合主内存的语言运行时支持
作者:
Nakagawa Gaku
;
Oikawa Shuichi
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
garbage collection;
language runtime;
memory management;
non-volatile memory;
8.
A low power DRAM refresh control scheme for 3D memory cube
机译:
用于3D内存立方体的低功耗DRAM刷新控制方案
作者:
Ying Wang
;
Yinhe Han
;
Huawei Li
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
3D Stacked DRAM;
Retention Time and Refresh;
9.
A flexibly fault-tolerant FU array processor and its self-tuning scheme to locate permanently defective unit
机译:
灵活的容错FU阵列处理器及其自我调整方案,可定位永久性故障单元
作者:
Yao Jun
;
Nakashima Yasuhiko
;
Saito Mitsutoshi
;
Hazama Yohei
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
10.
A globally asynchronous locally synchronous DMR architecture for aggressive low-power fault toleration
机译:
全局异步本地同步DMR体系结构,可实现低功耗容错能力
作者:
Yuttakonki Yuttakon
;
Yao Jun
;
Nakashima Yasuhiko
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
11.
Kernel data race detection using debug register in Linux
机译:
在Linux中使用调试寄存器进行内核数据竞争检测
作者:
Yunyun Jiang
;
Yi Yang
;
Tian Xiao
;
Sheng Tianwei
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
Linux kernel;
data race detection;
debug register;
sample;
synchronization;
12.
A Perpetuum Mobile 32bit CPU with 13.4pJ/cycle, 0.14#x00B5;A sleep current using Reverse Body Bias Assisted 65nm SOTB CMOS technology
机译:
采用反向人体偏置辅助65nm SOTB CMOS技术的Perpetuum移动32位CPU,具有13.4pJ /周期,0.14µA睡眠电流
作者:
Ishibashi Koichiro
;
Sugii Nobuyuki
;
Usami Kimiyoshi
;
Amano Hideharu
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
CMOS;
MCU;
SOI;
SOTB;
13.
Embedded SRAM and Cortex-M0 core with backup circuits using a 60-nm crystalline oxide semiconductor for power gating
机译:
具有备用电路的嵌入式SRAM和Cortex-M0内核,采用60 nm晶体氧化物半导体进行电源门控
作者:
Tamura Hikaru
;
Kato Kiyoshi
;
Ishizu Takahiko
;
Onuki Tatsuya
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
CAAC-OS;
Cortex-M0;
embedded SRAM;
overhead and SoC;
power gating;
14.
Aggressive use of Deep Sleep mode in low power embedded systems
机译:
在低功耗嵌入式系统中积极使用深度睡眠模式
作者:
Segawa Jun#039
;
ichi
;
Shirota Yusuke
;
Fujisaki Koichi
;
Kimura Tetsuro
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
OS;
embedded system;
low power;
non-volatile device and Deep Sleep mode;
15.
An energy optimization method for vector processing mechanisms
机译:
矢量处理机制的能量优化方法
作者:
Ye Gao
;
Sato Masayuki
;
Egawa Ryusuke
;
Takizawa Hiroyuki
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
energy;
multimedia application;
optimization;
power consumption;
vector architecture;
16.
A fine grained power management supported by just-in-time compiler
机译:
即时编译器支持的精细电源管理
作者:
Wada Motoki
;
Sato Mikiko
;
Namiki Mitaro
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
JIT compiler;
dynamic analysis;
power gating;
17.
A task-level pipelined many-SIMD augmented reality processor with congestion-aware network-on-chip scheduler
机译:
任务级流水线多SIMD增强现实处理器,具有拥塞感知的片上网络调度程序
作者:
Kim Gyeonghoon
;
Seongwook Park
;
Kyuho Lee
;
Kim Youchang
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
关键词:
2D-mesh NoC;
augmented reality;
dynamic resource management;
heterogeneous multicore;
network-on-chip scheduler;
object recognition;
18.
A low power NoC router using the marching memory through type
机译:
低功耗NoC路由器,通过类型使用行进内存
作者:
Yasudo Ryota
;
Kagami Takahiro
;
Amano Hideharu
;
Nakase Yasunobu
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
19.
Keynote invited speaker's biography
机译:
主题演讲和特邀演讲者传记
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
20.
Final program
机译:
最终程序
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
21.
Special session speaker's biography
机译:
特别会议发言人的传记
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
22.
Message from the organizing committee chair
机译:
组委会主席致辞
作者:
Kobayashi Hiroaki
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
23.
Message from the program committee chairs
机译:
计划委员会主席的话
作者:
Ikeda Makoto
;
Arakawa Fumio
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
24.
Panel discussions: Toward wearable computing era, how COOL chip architecture and tools will evolve?
机译:
小组讨论:在可穿戴计算时代,COOL芯片架构和工具将如何发展?
作者:
Arakawa Fumio
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
25.
List of the committees members
机译:
委员会成员名单
会议名称:
《IEEE Symposium on Low-Power and High-Speed Chips》
|
2014年
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