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SOC Conference, 2006 IEEE International
SOC Conference, 2006 IEEE International
召开年：
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Austin,TX
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1.
Tutorial: RAM-based Circuits and Architectures for Multimedia and Signal Processing SOCs
机译：
教程：用于多媒体和信号处理SOC的基于RAM的电路和体系结构
作者：
Margala
;
M.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
2.
High-performance energy-efficient memory circuit technologies for sub-45nm technologies
机译：
低于45nm技术的高性能节能存储电路技术
作者：
Agarwal
;
A.
;
Krishnamurthy
;
R.K.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
3.
An On-Chip Measurement Circuit for Calibration by Combination Selection
机译：
用于通过组合选择进行校准的片上测量电路
作者：
Maunu
;
J.
;
Marku
;
J.
;
Laiho
;
M.
;
Paasio
;
A.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
calibration;
electric current measurement;
integrated circuit measurement;
CMOS technologies;
combination selection;
current source calibration;
mismatch compensation accuracy;
on-chip current measurement circuit;
4.
Energy-Aware Code Replication for Improving Reliability in Embedded Chip Multiprocessors
机译：
能源敏感代码复制，可提高嵌入式芯片多处理器的可靠性
作者：
Guilin Chen
;
Ozturk
;
O.
;
Guangyu Chen
;
Kandemir
;
M.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
embedded systems;
hardware-software codesign;
multiprocessing systems;
program compilers;
reliability;
embedded chip multiprocessors;
energy-aware code replication;
energy-aware reliability support;
hardware-software codesign;
memory space consumption;
5.
A Leakage Compensation Technique for Dynamic Latches and Flip-Flops in Nano-Scale CMOS
机译：
纳米级CMOS动态锁存器和触发器的泄漏补偿技术
作者：
Hansson
;
M.
;
Alvandpour
;
A.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS logic circuits;
compensation;
flip-flops;
leakage currents;
nanoelectronics;
dynamic flip-flops;
dynamic latches;
dynamic transmission-gate flip-flop;
leakage compensation technique;
leakage tolerance;
nanoscale CMOS;
6.
Supply and Threshold Voltage Optimization for Temperature Variation Insensitive Circuit Performance: A Comparison
机译：
针对温度变化不敏感电路性能的电源和阈值电压优化：比较
作者：
Kumar
;
R.
;
Kursun
;
V.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
circuit optimisation;
electric potential;
integrated circuit design;
integrated circuit testing;
CMOS technology;
design methodologies;
energy tradeoffs;
speed aspects;
supply voltage optimization;
temperature variation insensitive circui;
7.
Analysis of Subthreshold Finfet Circuits for Ultra-Low Power Design
机译：
超低功耗设计的亚阈值Finfet电路分析
作者：
Xiaoxia Wu
;
Feng Wang
;
Yuan Xie
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
MOSFET circuits;
integrated circuit design;
low-power electronics;
FINFET circuits;
bulk CMOS technology;
minimum energy consumption;
optimal power supply point;
soft error vulnerability;
ultra-low power design;
8.
Design of Ultra-Low Power Combinational Standard Library Cells Using A Novel Leakage Reduction Methodology
机译：
采用新型减少泄漏方法设计超低功耗组合标准库
作者：
Lakshmikanthan
;
P.
;
Sahni
;
K.
;
Nunez
;
A.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
leakage currents;
low-power electronics;
leakage power loss;
leakage reduction methodology;
pull-down network;
pullup network;
ultralow power combinational CMOS standard cell library;
ultralow power combinational standard library cells;
9.
Automatic Synthesis of Interface Circuits from Simplified IP Interface Protocols and Matching Information
机译：
根据简化的IP接口协议和匹配信息自动综合接口电路
作者：
ChangRyul Yun
;
YoungHwan Bae
;
HanJin Cho
;
KyoungSon Jhang
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
IP networks;
finite state machines;
protocols;
automatic interface synthesis;
automatic synthesis;
interface circuits;
matching information;
simplified IP interface protocols;
10.
Performance Improvements through Timing Driven Reconfiguration of Black-Boxes in Platform FPGAs
机译：
通过平台FPGA中的黑盒的时序驱动重新配置来提高性能
作者：
Sundararajan
;
P.
;
Krishnamurthy
;
S.
;
Vijaykrishnan
;
N.
;
Chaudhary
;
K.
;
Jayaraman
;
R.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
digital signal processing chips;
field programmable gate arrays;
DSP design;
field programmable gate arrays;
optimal register placement;
platform FPGAs;
reconfigurable black-boxes;
timing driven reconfiguration;
11.
A Reconfigurable Viterbi Traceback for Implemenation on Turbo Decoding Array
机译：
用于Turbo解码阵列的可重构Viterbi追溯
作者：
Ahmed
;
I.
;
Arslan
;
T.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
Viterbi decoding;
trellis codes;
turbo codes;
CDMA2000;
GSM;
IEEE 802.11;
UMC process technology;
Viterbi traceback operation;
WCDMA;
constraint lengths;
reconfigurable Viterbi decoding;
reconfigurable fabric implementation;
reconfigurable trace back processing;
size;
12.
SoC Design Space Exploration through Automated IP Selection from SystemC IP Library
机译：
通过从SystemC IP库自动选择IP进行SoC设计空间探索
作者：
Mathaikutty
;
D.
;
Shukla
;
S.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
circuit CAD;
industrial property;
integrated circuit design;
integrated circuit modelling;
meta data;
system-on-chip;
IP reflection;
SoC design space exploration;
SoC simulation models;
SystemC IP library;
algorithmic analysis;
automated IP selection;
component comp;
13.
A Design Methodology for a Low-Power, Temperature-Aware SoC Developed for Medical Image Processors
机译：
专为医学图像处理器开发的低功耗，温度感知SoC的设计方法
作者：
Zhenyu Qi
;
Wei Huang
;
Cabe
;
A.
;
Wenqian Wu
;
Yan Zhang
;
Rose
;
G.
;
Stan
;
M.R.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
biomedical ultrasonics;
image enhancement;
integrated circuit design;
low-power electronics;
medical image processing;
system-on-chip;
thermal management (packaging);
SoC design methodology;
adaptive body-bias circuit;
dynamic thermal management;
dynamic voltage s;
14.
Silicon Debug and DFT for SOC IP
机译：
用于SOC IP的芯片调试和DFT
作者：
Dakwala
;
N.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
15.
Geometric Tiling for Reducing Power Consumption in Structured Matrix Operations
机译：
减少结构化矩阵运算中功耗的几何平铺
作者：
Chen
;
G.
;
Xue
;
L.
;
Kim
;
J.
;
Sobti
;
K.
;
Deng
;
L.
;
Sun
;
X.
;
Pitsianis
;
N.
;
Chakrabarti
;
C.
;
Kandemir
;
M.
;
Vijaykhshnan
;
N.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
digital arithmetic;
geometry;
low-power electronics;
matrix algebra;
microprocessor chips;
geometric tiling;
matrix computations;
power consumption reduction;
power saving potential;
structured matrix operations;
16.
High Read Stability and Low Leakage SRAM Cell Based on Data/Bitline Decoupling
机译：
基于数据/位线去耦的高读取稳定性和低泄漏SRAM单元
作者：
Zhiyu Liu
;
Kursun
;
V.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS memory circuits;
SRAM chips;
9T SRAM cell;
CMOS technology;
SRAM cell stability;
data stability;
data storage nodes;
data/bitline decoupling;
high read stability;
reduced leakage power consumption;
static random access memory;
17.
Table of Contents
机译：
目录
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
analogue integrated circuits;
digital signal processing chips;
embedded systems;
low-power electronics;
mixed analogue-digital integrated circuits;
radiofrequency integrated circuits;
reconfigurable architectures;
system-on-chip;
DSP;
RF circuit;
SOC;
analog design;
18.
Method for Managing Electromigration in SOC''S When Designing for Both Reliability and Manufacturing
机译：
设计可靠性和制造性时在SOC''S中管理电迁移的方法
作者：
Chow
;
K.
;
Abercrombie
;
D.
;
Basel
;
M.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
design for manufacture;
electromigration;
failure analysis;
integrated circuit design;
integrated circuit reliability;
integrated circuit yield;
nanoelectronics;
system-on-chip;
DFM;
DFR;
SoC nanometer designs;
circuit performance degradation;
design for manufacturi;
19.
Memories: Exploiting Them and Developing Them
机译：
记忆：开发和发展它们
作者：
Reohr
;
W.R.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
DRAM chips;
cache storage;
embedded systems;
integrated memory circuits;
memory architecture;
DRAM;
L1 cache memory design;
circuit design;
memories;
microarchitecture;
20.
A Low-swing Signaling Circuit Technique for 65nm On-chip Interconnects
机译：
用于65nm片内互连的低摆信号电路技术
作者：
Venkatraman
;
V.
;
Anders
;
M.
;
Kaul
;
H.
;
Burleson
;
W.
;
Krishnamurthy
;
R.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
integrated circuit interconnections;
system-on-chip;
CMOS technology;
delay reduction;
low swing signaling circuit;
on chip interconnects;
receiver circuit;
size 65 nm;
21.
A Mimo Receiver SOC for CDMA Applications
机译：
用于CDMA应用的Mimo接收器SOC
作者：
Tongtong Chen
;
Zhengtao Yu
;
Yuantao Peng
;
Yanbin Zhang
;
Huaiyu Dai
;
Xun Liu
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
3G mobile communication;
CMOS integrated circuits;
MIMO communication;
channel capacity;
code division multiple access;
integrated circuit design;
quadrature amplitude modulation;
quadrature phase shift keying;
radio receivers;
reconfigurable architectures;
system;
22.
A Dual-Function Filter for 5.25GHZ Narrowband and 3.6GHZ-10.1GHZ Ultrawideband Systems
机译：
适用于5.25GHZ窄带和3.6GHZ-10.1GHZ超宽带系统的双功能滤波器
作者：
Dinh
;
A.
;
Bi Pham
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
field effect MMIC;
low noise amplifiers;
microwave filters;
ultra wideband technology;
CMOS technology;
channel select filter;
dual function filter;
frequency 3.6 GHz to 10.1 GHz;
frequency 5.25 GHz;
interference signal;
power 27 mW;
size 0;
23.
H.264 Decoder Implementation on a Dynamically Reconfigurable Instruction Cell Based Architecture
机译：
基于动态可重构指令单元架构的H.264解码器实现
作者：
Major
;
A.
;
Ying Yi
;
Nousias
;
I.
;
Milward
;
M.
;
Khawam
;
S.
;
Arslan
;
T.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
decoding;
reconfigurable architectures;
video coding;
ANSI-C programmable architecture;
H.264 decoder implementation;
architecture specific transforms;
baseline profile compliant decoder;
dynamically reconfigurable instruction cell based architecture;
ffmpeg lib;
24.
A Compact and High Performance Switch for Circuit-Switched Network-On-Chip
机译：
用于电路交换片上网络的紧凑型高性能交换机
作者：
Phi-Hung Pham
;
Kumar
;
Y.
;
Chulwoo Kim
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS digital integrated circuits;
circuit switching;
network-on-chip;
CMOS process technology;
circuit-switched network-on-chip;
compact switch architecture;
path-setup scheme;
size 0.13 micron;
torus topology;
25.
A 120nm CMOS Fully Differential Rail-to-Rail I/O Opamp with Highly Constant Signal Behavior
机译：
具有高恒定信号特性的120nm CMOS全差分轨到轨I / O运算放大器
作者：
Weixun Yan
;
Zimmermann
;
H.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS digital integrated circuits;
differential amplifiers;
operational amplifiers;
class-AB rail-to-rail output stage;
digital CMOS technology;
fully differential I/O opamp design;
large-signal behavior;
power transfer efficiency;
rail-to-rail input common-mode;
26.
A CMOS Low-Noise, Low-Dropout Regulator for Transceiver SOC Supply Management
机译：
用于收发器SOC电源管理的CMOS低噪声，低压降稳压器
作者：
Wonseok Oh
;
Bakkaloglu
;
B.
;
Aravind
;
B.
;
Siew Kuok Hoon
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
1/f noise;
CMOS integrated circuits;
amplifiers;
system-on-chip;
telecommunication power supplies;
transceivers;
1/f noise;
CMOS;
SOC;
chopper stabilized error amplifier;
chopping frequencies;
current 100 muA;
frequency 10 kHz;
low dropout regulator;
low noise;
quiesce;
27.
SOC Design Challenges in a Multi-threaded 65nm Dual Core Xeon庐 MP Processor
机译：
多线程65nm双核Xeon®MP处理器中的SOC设计挑战
作者：
Varada
;
R.
;
Tarn
;
S.
;
Benoit
;
J.
;
Chou
;
K.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
microprocessor chips;
multi-threading;
system-on-chip;
SOC design;
frequency 3.4 GHz;
multithreaded dual core Xeon MP processor;
size 65 nm;
Processor;
Processor Core;
Xeon庐;
28.
Integration of Configurable Processors in a Multiprocessor Platform
机译：
在多处理器平台中集成可配置处理器
作者：
Provost
;
S.
;
Lavigueur
;
B.
;
Bois
;
G.
;
Nicolescu
;
G.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
hardware-software codesign;
instruction sets;
integrated circuit design;
multiprocessing systems;
system-on-chip;
video coding;
MPEG-4 encoder;
SoC;
codesign methodology;
custom instruction extensions;
multiple configurable processors;
multiprocessor platform;
speed;
29.
MTNET: Design and Optimization of a Wireless SOC Test Framework
机译：
MTNET：无线SOC测试框架的设计和优化
作者：
Dan Zhao
;
Yi Wang
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
circuit optimisation;
embedded systems;
integrated circuit design;
integrated circuit testing;
network routing;
system-on-chip;
MTNet;
billion-transistor SoC testing;
embedded cores;
geographic routing algorithm;
nanoscale SoC testing;
path driven test scheduling a;
30.
A Trace Based Framework for Validation of SoC Designs with GALS Systems
机译：
使用GALS系统验证SoC设计的基于跟踪的框架
作者：
Suhaib
;
S.
;
Mathaikutty
;
D.
;
Shukla
;
S.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
industrial property;
synchronisation;
system-on-chip;
SoC designs;
asynchronous communication links;
globally asynchronous locally synchronous;
synchronous intellectual property;
system-on-chip;
trace based framework;
31.
A 24-mW 0.02-mm2 1.5-GHz DLL-Based Frequency Multiplier in 130-nm CMOS
机译：
130nm CMOS中的基于24-mW 0.02mm2 1.5GHz DLL的倍频器
作者：
Mesgarzadeh
;
B.
;
Alvandpour
;
A.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
delay lock loops;
frequency multipliers;
injection locked oscillators;
integrated circuit noise;
jitter;
phase noise;
CMOS;
DLL-based frequency multiplier;
delay-locked loop;
frequency 100 MHz to 1.5 GHz;
injection-locked slave ring oscill;
32.
A Scalable Packet Sorting Circuit for High-Speed WFQ Packet Scheduling
机译：
高速WFQ分组调度的可扩展分组排序电路
作者：
McLaughlin
;
K.
;
Sezer
;
S.
;
Blume
;
H.
;
Yang
;
X.
;
Kupzog
;
F.
;
Noll
;
T.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
IP networks;
queueing theory;
scheduling;
trees (mathematics);
IP packet scheduler;
custom memory layout;
high-speed weighted fair queuing;
matching circuitry;
quality of service;
scalable packet sorting circuit;
search tree;
33.
A Real Time Programmable Encoder for Low Density Parity Check Code as specified in the IEEE P802.16E/D7 Standard and its Efficient Implementation on a DSP Processor
机译：
IEEE P802.16E / D7标准中指定的低密度奇偶校验码的实时可编程编码器及其在DSP处理器上的高效实现
作者：
Khan
;
Z.
;
Arslan
;
T.
;
MacDougall
;
S.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
digital signal processing chips;
encoding;
parity check codes;
ASIC implementation;
DSP processor;
FPGA implementation;
H matrix;
IEEE P802.16E/D7 standard;
low density parity check code;
pipelined architecture;
real time programmable encoder;
34.
A General Method to VLSI Polyphase Filter Analysis and Design for Integrated RF Applications
机译：
集成RF应用中VLSI多相滤波器分析和设计的通用方法
作者：
Hongjiang Song
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
VLSI;
filters;
network analysis;
VLSI polyphase filter analysis;
VLSI polyphase filter circuit structures;
integrated RF applications;
polyphase signal constraint;
symmetry property;
35.
A Novel Mini-LVDS Receiver in 0.35-um CMOS
机译：
0.35um CMOS的新型Mini-LVDS接收器
作者：
Chung-Yuan Chen
;
Jia-Hong Wang
;
Tai-Ping Sun
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
receivers;
CMOS technology;
differential transmission technique;
flat-plane application;
low voltage swing;
low-voltage differential signaling;
mini-LVDS receiver;
power 3.5 mW;
receiver circuits;
size 0.35 mum;
voltage 3.3 V;
36.
A Reconfigurable CMOS Power Amplifier Operating from 0.9 TO 2.4 GHZ for WPAN Application
机译：
用于WPAN应用的可重构CMOS功率放大器，工作频率范围为0.9至2.4 GHz
作者：
Seok-Oh Yun
;
Hyung-Joun Yoo
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS analogue integrated circuits;
UHF integrated circuits;
UHF power amplifiers;
personal area networks;
CMOS technology;
WPAN application;
driver stage;
frequency 0.9 GHz to 2.4 GHz;
gain 21.8 dB to 27.5 dB;
interstage matching;
output matching stage;
power added;
37.
A Pulse-Based Full-Band UWB Transceiver SoC in 0.18驴m SiGe BiCMOS
机译：
0.18驴m SiGe BiCMOS中的基于脉冲的全波段UWB收发器SoC
作者：
Haolu Xie
;
Siqiang Fan
;
Xin Wang
;
Wang
;
A.
;
Zhihua Wang
;
Hongyi Chen
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
BiCMOS integrated circuits;
Gaussian processes;
Ge-Si alloys;
analogue-digital conversion;
correlators;
low noise amplifiers;
low-power electronics;
media streaming;
phase shift keying;
power consumption;
pulse generators;
system-on-chip;
transceivers;
ultra wideband;
38.
A Novel 8-Phase PLL Design for PWM Scheme in High Speed I/O Circuits
机译：
高速I / O电路中用于PWM方案的新型8相PLL设计
作者：
Rui Tang
;
Yong-Bin Kim
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
phase locked loops;
pulse width modulation;
voltage-controlled oscillators;
8-phase PLL design;
I/O circuits;
PWM scheme;
VCO;
charge-pump detector;
duty cycle;
high speed wireline communication;
level shifter structure;
phase- frequency detector;
phase-locked-loop;
39.
A Timing Jitter Reduction Technique in a Cyclic Injection Clock Multiplier for Data Communication System
机译：
数据通信系统中循环注入时钟乘法器中的时序抖动减少技术
作者：
Qingjin Du
;
Jingcheng Zhuang
;
Kwasniewski
;
T.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
clocks;
data communication;
delay lock loops;
multiplying circuits;
timing jitter;
CMOS technology;
DLL clock generator;
auxiliary loop;
cycle- to-cycle timing jitter reduction;
cyclic injection clock multiplier;
data communication system;
frequency 0.9 GHz to 2.9;
40.
A 1.3 V 30-mW 8-BIT 166-MS/s A/D Converter in 0.18 驴m CMOS with Reference Generator
机译：
带有参考发生器的0.18驴CMOS中的1.3 V 30mW 8位166-MS / s A / D转换器
作者：
Li Jing-Hu
;
Yu Ming-Yan
;
Wang Yong-Sheng
;
Wang Jin-Xiang
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
amplifiers;
analogue-digital conversion;
choppers (circuits);
comparators (circuits);
integrated circuit design;
low-power electronics;
A/D converter;
CMOS technology;
analog-to-digital converter;
differential nonlinearity;
integral nonlin;
41.
Multi-Project System-on-Chip (MP-SoC): A Novel Test Vehicle for SoC Silicon Prototyping
机译：
多项目片上系统（MP-SoC）：一种用于SoC硅原型设计的新型测试工具
作者：
Chun-Ming Huang
;
Kuen-Jong Lee
;
Chih-Chyau Yang
;
Wen-Hsiang Hu
;
Shi-Shen Wang
;
Jeng-Bin Chen
;
Chi-Shi Chen
;
Van
;
L.-D.
;
Chien-Ming Wu
;
Wei-Chang Tsai
;
Jing-Yang Jou
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS logic circuits;
integrated circuit design;
system-on-chip;
MP-SoC-l;
TSMC CMOS generic logic process technology;
arbitration mechanism;
individual IP blocks;
logic implementations;
multiproject system-on-chip design;
physical implementations;
size 0.13 mum;
sy;
42.
VLSI Architecture for Encryption and Watermarking Units Towards the Making of a Secure Camera
机译：
用于加密和加水印单元的VLSI体系结构，以实现安全摄像机的制作
作者：
Adamo
;
O.B.
;
Mohanty
;
S.P.
;
Kougianos
;
E.
;
Varanasi
;
M.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
VLSI;
cameras;
cryptography;
data privacy;
discrete cosine transforms;
image coding;
message authentication;
watermarking;
DCT-based visible watermarking;
Rijndael AES algorithm;
VLSI architecture;
authentication;
biometric data;
data privacy;
discrete cosine transfor;
43.
A Trace-Driven Validation Methodology for Multi-Processor SOCS
机译：
多处理器SOCS的跟踪驱动验证方法
作者：
Bhadra
;
J.
;
Trofimova
;
E.
;
Giordano
;
L.J.
;
Abadir
;
M.S.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
circuit simulation;
integrated circuit design;
multiprocessing systems;
system-on-chip;
SoC design;
abstract representation;
design validation;
multiprocessor SoC;
multiprocessor systems-on-chip;
simulation-based abstraction scheme;
system level implementation;
tra;
44.
A low complexity, low power, programmable QRS detector based on wavelet transform for Implantable Pacemaker IC
机译：
一种基于小波变换的低复杂度，低功耗，可编程QRS检测器，用于植入式起搏器IC
作者：
Thanh-Tung Hoang
;
Jong-Pil Son
;
Yu-Ri Kang
;
Chae-Ryung Kim
;
Hae-Young Chung
;
Soo-Won Kim
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
channel bank filters;
field programmable gate arrays;
integrated circuit design;
low-power electronics;
pacemakers;
signal detection;
wavelet transforms;
FPGA;
MIT-BIH Arrhythmia database;
database archives;
deactive filter banks;
down sampling rate structure;
impla;
45.
Applying ESL in A Dual-Core SoC Platform Designing
机译：
在双核SoC平台设计中应用ESL
作者：
Su
;
A.P.
;
Chen
;
R.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
digital signal processing chips;
system-on-chip;
SystemC;
digital signal processor;
dual-core system-on-chip platform;
electronic system level design;
inter-process communication;
transaction level component;
46.
A Detailed Vth-Variation Analysis for Sub-100-nm Embedded SRAM Design
机译：
100nm以下嵌入式SRAM设计的详细Vth变异分析
作者：
Yamaoka
;
M.
;
Onodera
;
H.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
SRAM chips;
integrated circuit design;
SRAM design;
SRAM operating margin analysis;
Vsubth/sub variation analysis;
47.
Low-Power and Process Variation Tolerant Memories in sub-90nm Technologies
机译：
90nm以下技术的低功耗和过程变化容限存储器
作者：
Mukhopadhyay
;
S.
;
Ghosh
;
S.
;
Kim
;
K.
;
Roy
;
K.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
SRAM chips;
integrated circuit design;
integrated circuit yield;
nanoelectronics;
SRAM parametric failures;
design level optimization methods;
interdie variation;
intradie variation;
leakage spread reduction;
low-power nanoscale memories design;
postsilicon tuning;
48.
Fuse Area Reduction Based on Quantitative Yield Analysis and Effective Chip Cost
机译：
基于定量产量分析和有效芯片成本的保险丝面积缩减
作者：
Garg
;
A.
;
Dubey
;
P.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
embedded systems;
integrated circuit yield;
system-on-chip;
SoC yield;
anti fuses;
effective chip cost;
embedded memory yield;
fuse area reduction;
laser fuses;
quantitative yield analysis;
silicon yield database;
system-on-chip;
yield enhancement;
yield prediction m;
49.
Modeling the Impact of Process Variation on Critical Charge Distribution
机译：
模拟过程变化对临界电荷分布的影响
作者：
Qian Ding
;
Rong Luo
;
Hui Wang
;
Huazhong Yang
;
Yuan Xie
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
Monte Carlo methods;
SRAM chips;
semiconductor process modelling;
Monte Carlo analysis;
SRAM;
benchmark circuit;
critical charge distribution;
empirical model;
gate length variations;
process variation impact;
soft error vulnerability;
storage circuits;
threshold vo;
50.
Low-Power Priority Encoder and Multiple Match Detection Circuit for Ternary Content Addressable Memory
机译：
三元内容可寻址存储器的低功耗优先级编码器和多重匹配检测电路
作者：
Mohan
;
N.
;
Fung
;
W.
;
Sachdev
;
M.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
content-addressable storage;
encoding;
integrated circuit testing;
low-power electronics;
CMOS technology;
multiple match detection circuits;
priority encoder;
size 0.18 mum;
ternary content addressable memory;
51.
Embedded Controllers for Solving Complex Industry Applications
机译：
解决复杂行业应用的嵌入式控制器
作者：
Saalmueller
;
J.
;
Wuertz
;
J.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
industrial control;
production engineering computing;
standards;
system-on-chip;
CoreConnect technology;
IBM servers;
PowerPC 440 controller;
SoC chip;
complex industry automation;
distributed industry standard interfaces;
high-end servers;
off-the-shelf embedded c;
52.
Process Variation Aware Parallelization Strategies for MPSoCs
机译：
MPSoC的工艺变化感知并行化策略
作者：
Srinivasan
;
S.
;
Ramadoss
;
R.
;
Vijaykrishnan
;
N.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
microprocessor chips;
multiprocessing systems;
system-on-chip;
load balanced parallelization schemes;
manufacturing expectations;
manufacturing uncertainties;
microprocessors;
multiprocessor system on chips;
nonuniform workload generation;
process variation aware;
53.
Compiler Support for Voltage Islands
机译：
电压岛的编译器支持
作者：
Guangyu Chen
;
Kandemir
;
M.
;
Karakoy
;
M.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
embedded systems;
industrial property;
microprocessor chips;
multiprocessing systems;
program compilers;
IP placement;
embedded multiprocessor architecture;
microprocessor chips;
software compiler support;
voltage islands;
54.
Crosstalk-Aware Energy Efficient Encoding for Instruction Bus through Code Compression
机译：
通过代码压缩对指令总线进行串扰感知的节能编码
作者：
Vaidyanathan
;
B.
;
Yuan Xie
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
crosstalk;
data compression;
embedded systems;
low-power electronics;
TMS320C6x benchmarks;
code compression;
crosstalk-aware energy efficient encoding;
instruction bus;
inter-wire coupling transition;
limited memory resources;
on-chip bus energy consumption;
55.
Cache Organization for Embeded Processors: CAM-vs-SRAM
机译：
嵌入式处理器的缓存组织：CAM-vs-SRAM
作者：
Mohammad
;
B.
;
Bassett
;
P.
;
Abraham
;
J.
;
Aziz
;
A.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
SRAM chips;
cache storage;
content-addressable storage;
embedded systems;
integrated circuit design;
leakage currents;
CAM-tag based cache designs;
DSP core design comparison;
cache organization;
content addressable memory;
embedded processor design;
leakage power;
56.
Effects of Interconnect Process Variations on Signal Integrity
机译：
互连过程变化对信号完整性的影响
作者：
Demircan
;
E.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
Monte Carlo methods;
VLSI;
integrated circuit interconnections;
integrated circuit modelling;
Monte Carlo method;
VLSI technologies;
crosstalk;
deep submicron designs;
interconnect parasitics;
interconnect process variations;
layout parasitic extraction;
metal thic;
57.
Optimal Multiple-Bit Huffman Decoding
机译：
最佳多位霍夫曼解码
作者：
Ya-Nan Wen
;
Sao-Jie Chen
;
Yu-Hen Hu
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
Huffman codes;
decoding;
entropy codes;
estimation theory;
optimisation;
probability;
Huffman entropy coder;
barrel shifter;
expected decoding throughput rate estimation;
heuristic algorithm;
optimal multiple-bit Huffman decoding;
optimization results;
probabilistic;
58.
Stochastic Glitch Estimation and Path Balancing for Statistical Optimization
机译：
统计优化的随机小故障估计和路径平衡
作者：
Hosun Shin
;
Naeun Zang
;
Juno Kim
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
circuit optimisation;
integrated circuit modelling;
low-power electronics;
statistical analysis;
stochastic processes;
ISCAS 85 benchmark circuits;
gate sizing technique;
glitch reduction;
path balancing;
probabilistic delay model;
size 0.16 mum;
statistical power;
59.
3-D Topologies for Networks-on-Chip
机译：
片上网络的3D拓扑
作者：
Pavlidis
;
V.F.
;
Friedman
;
E.G.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
integrated circuit design;
integrated circuit interconnections;
network topology;
network-on-chip;
3D topology;
NoC design;
analytic model;
communication channel;
interconnection networks;
network-on-chip;
physical planes;
processing elements;
wire delay;
zero-load l;
60.
Architecture and Implementation of Power and Area Efficient Receiver Equalization Circuit for High-Speed Serial Data Communication
机译：
高速串行数据通信的功率和面积有效接收器均衡电路的架构和实现
作者：
Hongjiang Song
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
data communication;
equalisers;
high-speed techniques;
multiplexing;
receivers;
system-on-chip;
PVT sensitivity;
SOC;
TMX equalizer circuit;
high-speed serial data communication;
receiver equalization circuit;
sampler circuit;
threshold multiplexing technique;
61.
Consideration of Transition-Time Variability in Statistical Timing Analysis
机译：
统计时序分析中过渡时间可变性的考虑
作者：
Kouno
;
T.
;
Onodera
;
H.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
integrated circuit design;
statistical distributions;
timing;
delay distribution;
delay variability;
fan-in gates;
linearized model;
signal arrival time;
signal transition time;
statistical static timing analysis;
statistical variable;
transition time variability;
62.
Performance Constraints Aware Voltage Islands Generation in SoC Floorplan Design
机译：
性能限制了SoC平面图设计中电压岛的生成
作者：
Ming-Ching Lu
;
Meng-Chen Wu
;
Hung-Ming Chen
;
Hui-Ru Jiang
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
integrated circuit layout;
low-power electronics;
system-on-chip;
MCNC benchmarks;
SoC floorplan design;
critical path delay;
floorplanning/placement methodology;
hierarchical design;
power consumption reduction;
power routing cost;
reusable intellectual property;
63.
Crosstalk-aware Energy Reduction in NoC Communication Fabrics
机译：
NoC通信结构中的可感知串扰的能源减少
作者：
Pande
;
P.P.
;
Haibo Zhu
;
Ganguly
;
A.
;
Grecu
;
C.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
crosstalk;
decoding;
encoding;
integrated circuit design;
integrated circuit interconnections;
low-power electronics;
network-on-chip;
NoC communication fabrics;
NoC data stream;
coding-decoding operation;
coupling capacitance;
crosstalk avoidance coding;
crosstalk-;
64.
Interrupt Communication on the SegBus platform
机译：
SegBus平台上的中断通信
作者：
Swaminathan
;
A.D.
;
Seceleanu
;
T.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
field buses;
field programmable gate arrays;
logic design;
system-on-chip;
FPGA technology;
SegBus platform;
interrupt communication;
multiple clock domains;
segmented bus architecture;
65.
Robust Sense Amplifier Design under Random Dopant Fluctuations in Nano-Scale CMOS Technologies
机译：
纳米级CMOS技术中随机掺杂波动下的稳健感测放大器设计
作者：
Yeung
;
J.
;
Mahmoodi
;
H.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS analogue integrated circuits;
amplifiers;
circuit optimisation;
integrated circuit design;
statistical analysis;
circuit design;
failure probability;
nano-scale CMOS technologies;
optimal transistor sizing;
optimization techniques;
process variations;
random d;
66.
Architecture for Energy Efficient Sphere Decoding
机译：
节能球体解码架构
作者：
Jenkal
;
R.
;
Hao Hua
;
Sule
;
A.
;
Davis
;
W.R.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
MIMO communication;
application specific integrated circuits;
decoding;
signal detection;
ASIC;
MIMO detection;
energy efficient sphere decoding;
logic energy efficiencies;
memory energy efficiencies;
67.
Energy-Aware MPEG-4 Single Profile in HW-SW Multi-Platform Implementation
机译：
HW-SW多平台实现中的节能型MPEG-4单一配置文件
作者：
Portero
;
A.
;
Talavera
;
G.
;
Monton
;
M.
;
Martinez
;
B.
;
Moreno
;
M.
;
Cathoor
;
F.
;
Carrabina
;
J.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
application specific integrated circuits;
digital signal processing chips;
field programmable gate arrays;
system-on-chip;
video coding;
ASIC;
Altera FPGA;
C++ language;
DSP;
HW-SW multiplatform implementation;
MPEG-4 single profile video encoder;
SystemC hard/soft;
68.
Efficient FPGA-Based Realization of Complex Squarer and Complex Conjugate using Embedded Multipliers
机译：
使用嵌入式乘法器的基于FPGA的复杂平方器和复杂共轭的高效实现
作者：
Shuli Gao
;
Al-Khalili
;
D.
;
Chabini
;
N.
;
Langlois
;
P.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
field programmable gate arrays;
logic design;
multiplying circuits;
FPGA-based realization;
Xilinx Spartan-3 FPGA;
complex conjugate;
complex squarer;
design methodology;
embedded multipliers;
69.
Architecture for Low Power Large Vocabulary Speech Recognition
机译：
低功耗大词汇量语音识别的体系结构
作者：
Chandra
;
D.
;
Pazhayaveetil
;
U.
;
Franzon
;
P.D.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
application specific integrated circuits;
embedded systems;
flash memories;
hidden Markov models;
low-power electronics;
microprocessor chips;
random-access storage;
speech recognition;
HMM;
RAM;
dedicated ASIC unit;
flash memory;
hidden Markov model;
low power embed;
70.
I/Q-Channel Mismatch Transfer and Amplification Effects and Applications to the Measurement and Calibration of Integrated VLIF RF Receivers
机译：
I / Q通道不匹配传输和放大效应及其在集成VLIF RF接收器的测量和校准中的应用
作者：
Hongjiang Song
;
Naqvi
;
S.R.
;
Bakkaloglu
;
B.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
calibration;
radio receivers;
radiofrequency integrated circuits;
wireless channels;
EVM measurement;
detection sensitivity;
integrated very low intermediate frequency RF receivers;
internal amplitude calculation;
l/Q channel mismatches calibration;
l/Q mismatch;
71.
Cell Switched Network-on-Chip -- Candidate for Billion-Transistor System-on-Chips
机译：
单元交换片上网络-十亿个晶体管片上系统的候选人
作者：
Yuhua Chen
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
network routing;
network-on-chip;
switched networks;
transistors;
billion-transistor system-on-chips;
cell switched NoC;
cell switched network-on-chip;
wormhole routing;
Network-on-Chip (NoC);
System-on-Chip (SoC);
cell switching;
wormhole routing;
72.
Reconfigurable Switched-Capacitor 驴驴 Modulator Topology Design
机译：
可重配置开关电容驴驴调制器的拓扑设计
作者：
Ying Wei
;
Pengbo Sun
;
Doboli
;
A.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
delta-sigma modulation;
integrated circuit design;
low-power electronics;
network topology;
switched capacitor networks;
system-on-chip;
PSoC device;
power consumption;
programmable system-on-chip;
reconfigurable DeltaSigma modulator topology design;
switched-capa;
73.
eXtreme Energy Conservation for Mobile Communications
机译：
移动通信极端节能
作者：
Chun
;
C.K.Y.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
low-power electronics;
mobile communication;
Freescale eXtreme energy conservation technology;
mobile communications;
multimedia content;
power management;
74.
Leakage Reduction for Domino Circuits in Sub-65nm Technologies
机译：
低于65nm技术的Domino电路减少泄漏
作者：
Agarwal
;
M.
;
Elakkumanan
;
P.
;
Sridhar
;
R.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
integrated circuit design;
integrated circuit modelling;
leakage currents;
nanoelectronics;
BSIM4 models;
CMOS technology;
domino circuits;
gate leakage current;
leakage current;
leakage power reduction;
size 45 nm;
source biasing effect;
st;
75.
Bit-Width Aware High-Level Synthesis for Digital Signal Processing Systems
机译：
用于数字信号处理系统的位宽感知高级综合
作者：
Le Gal
;
B.
;
Andriamisainat
;
C.
;
Casseaut
;
E.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
digital signal processing chips;
graph theory;
high level synthesis;
Sum of Absolute Difference;
annotated graph;
bit-width analysis;
bit-width aware high-level synthesis;
block matching algorithms;
data sizing;
datapaph structure optimizations;
digital signal pro;
76.
Platform-Based Behavior-Level and System-Level Synthesis
机译：
基于平台的行为级和系统级综合
作者：
Cong
;
J.
;
Yiping Fan
;
Guoling Han
;
Wei Jiang
;
Zhiru Zhang
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
field programmable gate arrays;
high level synthesis;
logic design;
system-on-chip;
FPGA;
RTL code;
SystemC description;
application-specific configurable processors;
behavior-level executable specifications;
electronic design automation;
heterogeneous multicore s;
77.
On Achieving Low-Power SoC Clock Tree Synthesis by Transition Time Planning via Buffer Library Study
机译：
通过缓冲库研究过渡时间规划实现低功耗SoC时钟树综合
作者：
Huang-Liang Chen
;
Hung-Ming Chen
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
VLSI;
buffer circuits;
clocks;
flip-flops;
integrated circuit design;
logic design;
low-power electronics;
system-on-chip;
VLSI design;
buffer library analysis;
clock power dissipation;
flip-flop design;
hierarchical clustering;
low-power SoC clock tree synthesis;
low;
78.
Substrate and Ground Noise Interactions in Mixed-Signal Circuits
机译：
混合信号电路中的基板和地面噪声相互作用
作者：
Salman
;
E.
;
Friedman
;
E.G.
;
Secareanu
;
R.M.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
CMOS integrated circuits;
integrated circuit modelling;
integrated circuit noise;
mixed analogue-digital integrated circuits;
CMOS inverter;
ground noise interaction;
inductive on-chip ground distribution network;
mixed-signal circuits;
nonlinear circuits;
79.
Novel Ternary Storage Cells and Techniques for Leakage Reduction in Ternary CAM
机译：
新型三元存储单元和减少三元CAM泄漏的技术
作者：
Mohan
;
N.
;
Sachdev
;
M.
会议名称：
《SOC Conference, 2006 IEEE International》
|
2006年
关键词：
content-addressable storage;
leakage currents;
low-power electronics;
leakage reduction;
ternary CAM;
ternary content addressable memories;
ternary storage cells;
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