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Multiple-Valued Logic, 2009. ISMVL '09
Multiple-Valued Logic, 2009. ISMVL '09
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Title Page iii
机译:
标题页iii
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
2.
Timing-Variation-Aware Multiple-Valued Current-Mode Circuit for a Low-Power Pipelined System
机译:
低功耗流水线系统的时序变化感知多值电流模式电路
作者:
Matsuura T.
;
Shirahama H.
;
Natsui M.
;
Hanyu T.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
CMOS logic circuits;
SPICE;
combinational circuits;
current-mode circuits;
low-power electronics;
CMOS;
HSPICE simulation;
combinational logic block;
dynamic current-source control technique;
frequency 0.8 GHz;
low-power aware pipelined system;
multiple-valued current-mode circuit;
operation-completion signal;
power dissipation;
size 90 nm;
timing-variation-aware MVCM circuit;
current-mode circuit;
dynamic current-source control;
multiple-valued logic;
output monitoring;
3.
Positive Primitive Structures
机译:
正原始结构
作者:
Romov B.A.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Galois fields;
constraint theory;
operations research;
Galois closure;
algebraic framework;
constraint satisfaction problems;
countable structures;
polymorphisms;
positive primitive structures;
Extendable partial clone;
Galois connection;
Partial polymorphism;
Positive primitive formula;
4.
Reviewers List
机译:
审稿人名单
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
5.
Copyright Page
机译:
版权页
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
6.
Frozen Boolean Partial Co-clones
机译:
冻结的布尔部分共克隆
作者:
Nordh G.
;
Zanuttini B.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
computational complexity;
constraint theory;
operations research;
set theory;
constraints complexity analysis;
frozen Boolean partial coclones;
partial coclone lattice;
7.
Fuzzy Logic Assisted Quantification of Gyral Deformation Index Using Magnetic Resonance Images for the Infantile Brain
机译:
磁共振图像对小儿脑的回旋畸变指数进行模糊逻辑辅助量化
作者:
Kobashi S.
;
Fujimoto Y.
;
Ogawa M.
;
Ando K.
;
Ishikura R.
;
Imawaki S.
;
Hirota S.
;
Hata Y.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
biomedical MRI;
brain;
diseases;
fuzzy logic;
fuzzy reasoning;
medical image processing;
paediatrics;
boundary model;
cerebral disease;
fuzzy logic assisted quantification;
gyral deformation index;
gyral labeling method;
infantile brain;
magnetic resonance image;
projection plane;
Gyral Labeling;
Magnetic Resonance Images;
Neonatal brain;
8.
Quantum Finite State Machines as Sequential Quantum Circuits
机译:
量子有限状态机作为顺序量子电路
作者:
Lukac M.
;
Perkowski M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
finite state machines;
logic design;
sequential circuits;
quantum finite state machines;
quantum logic synthesis;
quantum systems;
sequence detection;
sequential quantum circuits;
9.
Quantum Realization of Multiple-Valued Feynman and Toffoli Gates without Ancilla Input
机译:
不带辅助输入的多值Feynman门和Toffoli门的量子实现
作者:
Khan M.H.A.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Galois fields;
logic gates;
multivalued logic circuits;
quantum computing;
Galois field;
ancilla input free architecture;
liquid ion-trap realizable Muthukrishnan-Stroud gate;
macrolevel gate;
multiple-valued Feynman gate;
multiple-valued Toffoli gate;
synthesized quantum logic circuit;
technology dependent primitive gate;
Feynman gate;
GFSOP;
Toffoli gate;
10.
Regular Encodings from Max-CSP into Partial Max-SAT
机译:
从Max-CSP到部分Max-SAT的常规编码
作者:
Argelich J.
;
Cabiscol A.
;
Lynce I.
;
Manya F.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
computability;
constraint theory;
encoding;
Max-CSP;
Partial Max-SAT;
competitive performance profile;
nonauxiliary variables;
regular encoding;
Encodings;
11.
Counting Problems and Clones of Functions
机译:
计数问题和功能克隆
作者:
Bulatov A.A.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
combinatorial mathematics;
computational complexity;
formal logic;
clones of functions;
combinatorial problems;
counting problems;
multi-valued logic;
statistical physics;
clones;
complexity;
multi-valued functions;
12.
The Use of Multiple Connected Pseudo Minterms in the Synthesis of MVL Functions
机译:
多重连接的伪最小项在MVL函数合成中的使用
作者:
Sarif B.A.B.
;
Abd-El-Barr M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
multivalued logic circuits;
network synthesis;
multiple connected pseudo minterms;
multivalued logic circuit synthesis problem;
multivalued logic functions;
Connected pseudo minterm Injection Techniques.;
Direct Cover Heuristics;
Functional Synthesis;
MVL;
Multi-valued Logic;
13.
Quaternary Reed-Muller Expansions of Mixed Radix Arguments in Cryptographic Circuits
机译:
密码电路中混合基数参数的第四级Reed-Muller展开
作者:
Rafiev A.
;
Murphy J.P.
;
Yakovlev A.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Galois fields;
Reed-Muller codes;
binary codes;
cryptography;
digital arithmetic;
logic circuits;
optimisation;
Galois field arithmetic;
binary arithmetic;
cryptographic circuit;
gate level model;
logic synthesis;
mathematical representation;
mixed radix argument;
optimisation technique;
quaternary fixed polarity Reed-Muller expansion;
signal encoding;
mixed radix;
reed-muller expansions;
14.
On Endoprimal Monoids in Clone Theory
机译:
克隆理论中的内源性类半体
作者:
Machida H.
;
Rosenberg I.G.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
group theory;
clone theory;
lattice of inclusion-ordered endoprimal monoids;
universal algebra;
centralizer;
clone;
endoprimal monoid;
15.
Partial Clones Containing All Selfdual Monotonic Boolean Partial Functions
机译:
包含所有自对偶单调布尔部分函数的部分克隆
作者:
Haddad L.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Boolean functions;
set theory;
partial clone;
selfdual monotonic boolean partial function;
Partial Clones;
Selfdual Monotonic Boolean Partial Functions;
16.
A Study of Practical Causality Acquisition among Vital Signals
机译:
重要信号中实用因果关系习得的研究
作者:
Tsuchiya N.
;
Nakajima H.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
man-machine systems;
medical signal processing;
cause-effect structure acquisition;
human body;
human experts knowledge;
human-machine collaboration;
practical causality acquisition;
sensor signals;
target system;
visceral fat estimation;
vital signals;
cause-effect structure;
17.
Table of Contents
机译:
目录
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
18.
Hyperclones Determined by Total-Parts of Hyper-relations
机译:
由超级关系的总部分确定的超级克隆
作者:
Machida H.
;
Pantovic J.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
equivalence classes;
relational algebra;
set theory;
Rosenberg relation class;
central relations;
hyperclones;
hyperrelations;
nontrivial equivalence relations;
power set relations;
regular relations;
maximal hyperclones;
19.
Web-Based Nursing Care Quality Improvement System with Fuzzy Recommendation System
机译:
基于网络的护理质量改进系统与模糊推荐系统
作者:
Sakashita R.
;
Uchinuno A.
;
Kamiizumi K.
;
Tei K.
;
Awaya N.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Web sites;
fuzzy logic;
health care;
information filters;
Web site;
Web-based nursing care quality improvement system;
direct care;
family care;
fuzzy recommendation system;
incident prevention;
medical team coordination;
patient empowerment;
clinical impremantation;
measurement model;
quality improvement;
quality of nursing care;
20.
Fuzzy Rule Extraction from Nursing-Care Texts
机译:
从护理文本中提取模糊规则
作者:
Nii M.
;
Yamaguchi T.
;
Takahashi Y.
;
Uchinuno A.
;
Sakashita R.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
fuzzy reasoning;
genetic algorithms;
health care;
learning (artificial intelligence);
medical computing;
neural nets;
pattern classification;
text analysis;
feature selection method;
fuzzy if-then rule;
fuzzy rule extraction;
genetic algorithm;
neural network training;
numerical training data;
nursing-care text data classification;
21.
Optimization of Current-Mode MVD-ORNS Arithmetic Circuits
机译:
电流模式MVD-ORNS运算电路的优化
作者:
Inaba M.
;
Tanno K.
;
Sawada R.
;
Tanaka H.
;
Tamura H.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
SPICE;
digital arithmetic;
logic circuits;
CMOS 0.35 micrometer device parameters;
HSPICE simulation;
current-mode MVD-ORNS arithmetic circuits;
logic levels;
maximum logic level;
multiple-valued logic;
Current-mode CMOS arithmetic circuit;
ORNS;
22.
Application of Covering Codes for Reduced Representations of Logic Functions
机译:
覆盖代码在减少逻辑功能表示中的应用
作者:
Astola J.T.
;
Stankovic R.S.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
codes;
multivalued logic;
set theory;
covering code;
functional expression;
multiple-valued logic function;
nonempty set;
product term;
covering codes;
logic functions;
23.
Equivalence Checking of Reversible Circuits
机译:
可逆电路的等效检查
作者:
Wille R.
;
Grosse D.
;
Miller D.M.
;
Drechsler R.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Boolean functions;
computability;
decision diagrams;
formal specification;
logic circuits;
logic testing;
quantum gates;
Boolean satisfiability;
common specification;
decision diagram technique;
elementary quantum gate;
logic state;
primary input;
primary output;
reversible circuit equivalence checking;
reversible logic gate;
Equivalence Checking;
Formal Verification;
Quantum Computation;
Reversible Logic;
24.
An Overview of a Software Tool in Rough Non-deterministic Information Analysis
机译:
粗糙非确定性信息分析中的软件工具概述
作者:
Sakai H.
;
Kimura H.
;
Nakata M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
data analysis;
formal logic;
information analysis;
information systems;
possibility theory;
rough set theory;
certainty;
data table analysis;
modal logic;
nondeterministic information systems;
possibility;
rough nondeterministic information analysis;
rough sets;
software tool;
Data mining;
Non-deterministic information;
25.
Ternary Logic by 3rd Subharmonics and its Application to Multiway Switches
机译:
第三子谐波的三元逻辑及其在多路开关中的应用
作者:
Soma T.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Hadamard matrices;
error correction codes;
logic design;
parametric oscillators;
switches;
ternary logic;
3-cycle excitation;
3rd subharmonic oscillation;
Hadamard matrix;
error-correcting codes;
multiway switches;
parametron-like ternary logic;
error-correcting code;
majority operation;
multiway switch;
26.
Optimization of Fuzzy If-Then Rule Bases by Evolutionary Tuning of the Operations
机译:
通过操作的演化调整来优化If-then规则库
作者:
Moraga C.
;
Sugeno M.
;
Trillas E.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
distributed algorithms;
evolutionary computation;
fuzzy logic;
fuzzy set theory;
Takagi-Sugeno fuzzy if-then rule base;
contracting function;
distributed evolutionary algorithm;
evolutionary parameter tuning;
order automorphism;
Takagi-Sugeno systems;
evolutionary strategy;
rules optimization;
27.
Multi-path Switching Device Utilizing a Multi-terminal Nanowire Junction for MDD-Based Logic Circuit
机译:
利用多端子纳米线结的多路径开关设备用于基于MDD的逻辑电路
作者:
Kasai S.
;
Shiratori Y.
;
Miura K.
;
Nan-Jian Wu
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
aluminium compounds;
gallium arsenide;
multivalued logic circuits;
nanotechnology;
nanowires;
AlGaAs-GaAs;
inplane gate;
logic circuits;
multipath switching device;
multiterminal nanowire junction;
multivalued decision diagram;
nanometer scale Schottky wrap gates;
ternary path switching device;
GaAs;
multi-path switching device;
multi-valued decision diagram;
nanowire;
28.
Scalable Architectures for Design of Reversible Quaternary Multiplexer and Demultiplexer Circuits
机译:
可逆四元复用器和解复用器电路设计的可扩展架构
作者:
Khan M.H.A.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
demultiplexing equipment;
logic circuits;
multiplexing equipment;
binary reversible logic functions;
demultiplexer circuits;
quaternary reversible logic;
reversible quaternary multiplexer circuits;
scalable architectures;
Demultiplexer;
Multiplexer;
Quaternary Logic;
Reversible Logic;
29.
Representing the Genetic Code as a Function on a Galois Field Using the Reed-Muller Expansion
机译:
使用Reed-Muller展开将遗传密码表示为Galois场上的函数
作者:
Aleem H.A.
;
Green D.H.
;
Mavituna F.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Galois fields;
Reed-Muller codes;
biocomputing;
genetic engineering;
DNA;
Galois field;
Reed-Muller expansion;
amino acid;
biotic activity;
coding theory;
genetic code;
information theory;
nucleotides;
switching theory;
30.
Symposium Committees
机译:
专题讨论会委员会
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
31.
A Quaternary Decision Diagram Machine and the Optimization of its Code
机译:
四元决策图机及其代码优化
作者:
Sasao T.
;
Nakahara H.
;
Matsuura M.
;
Kawamura Y.
;
Butler J.T.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
decision diagrams;
optimisation;
logic function;
optimization;
quaternary decision diagram machine;
BDD;
MDD;
PLC;
code optimization;
logic simulation;
programmable logic controller;
32.
Quaternary Addition Circuits Based on SUSLOC Voltage-Mode Cells and Modeling with SystemVerilog©
机译:
基于SUSLOC电压模式单元的四级加法电路并使用SystemVerilog©建模
作者:
Datla S.R.
;
Thornton M.A.
;
Hendrix L.
;
Henderson D.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
adders;
decoding;
encoding;
network synthesis;
SUSLOC voltage-mode cells;
SystemVerilog modeling language;
adder circuit structures;
basic quaternary gates;
binary logic;
encoding-decoding circuits;
quaternary addition circuits;
supplementary symmetrical logic circuit structure;
Quaternary;
SUSLOC;
Voltage-mode circuit;
addition circuit;
33.
Attribute Reduction as Calculation of Focus in Granular Reasoning
机译:
属性约简作为粒度推理中的焦点计算
作者:
Kudo Y.
;
Murai T.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
inference mechanisms;
rough set theory;
atomic sentence;
attribute reduction;
focus calculation;
granular computing;
granular reasoning;
visibility;
focus;
rough set;
34.
Generalized Extended t-Norms as t-Norms of Type 2
机译:
广义扩展t范式作为类型2的t范式
作者:
Kawaguchi M.F.
;
Miyakoshi M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
fuzzy logic;
fuzzy set theory;
fuzzy truth values;
generalized extended t-norms;
type 2 fuzzy logics;
35.
Multiple-Valued Data Transmission Based on Time-Domain Pre-emphasis Techniques in Consideration of Higher-Order Channel Effects
机译:
考虑高阶信道效应的基于时域预加重技术的多值数据传输
作者:
Yuminaka Y.
;
Takahashi Y.
;
Henmi K.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
data communication;
intersymbol interference;
multivalued logic;
pulse width modulation;
higher-order channel effects;
multiple-valued data transmission;
pulse-width modulation pre-emphasis technique;
time-domain pre-emphasis techniques;
High-speed interface;
PWM;
multiple-valued data;
pre-emphasis technique;
36.
Message from the Program Chair
机译:
计划主席的话
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
37.
Applying Rough Sets to Information Tables Containing Missing Values
机译:
将粗糙集应用于包含缺失值的信息表
作者:
Nakata M.
;
Sakai H.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
equivalence classes;
rough set theory;
data tables;
information tables;
missing values discernibility;
possible equivalence classes;
rough approximations;
rough sets;
Lower and upper approximations;
Missing values;
38.
Multiple-Valued Constant-Power Adder for Cryptographic Processors
机译:
密码处理器的多值恒功率加法器
作者:
Baba Y.
;
Miyamoto A.
;
Homma N.
;
Aoki T.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
adders;
microprocessor chips;
public key cryptography;
HSPICE simulation;
RSA processors;
binary positive-digit number;
multiple-valued constant-power adder;
multiple-valued current-mode logic;
power analysis attacks;
power consumption;
tamper-resistant cryptographic processors;
Cryptographic Processor;
Current-Mode Logic;
Multiple-Valued Adder;
Power Analysis Attack;
Tamper-resistance;
39.
Time-Interleaved Polyphase Decimation Filter Using Signed-Digit Adders
机译:
使用有符号数字加法器的时间交错多相抽取滤波器
作者:
Murozuka M.
;
Ikeura K.
;
Adachi F.
;
Machida K.
;
Waho T.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
CMOS digital integrated circuits;
FIR filters;
adders;
flip-flops;
sigma-delta modulation;
signal sampling;
CMOS technology;
delayed flip-flop;
high-speed oversampling delta-sigma converter;
hold time constraint;
polyphase FIR filter;
size 0.18 mum;
ternary signed-digit full adder tree;
third-order filter;
time-interleaved polyphase decimation filter;
decimation filter;
delta-sigma modulator;
multiple-valued;
signed-digit;
40.
Paradigms for Non-classical Substitutions
机译:
非经典替代的范式
作者:
Eklund P.
;
Galan M.A.
;
Kortelainen J.
;
Stout L.N.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
set theory;
many-valued sets;
meta language;
nonclassical substitutions;
set-theoretic operation;
sets category;
variables substitutions;
41.
16-level Current-Mode Multiple-Valued Dynamic Memory with Increased Noise Margin
机译:
具有更高噪声裕量的16级电流模式多值动态存储器
作者:
Khodabndehloo G.
;
Mirhassani M.
;
Ahmadi M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
DRAM chips;
current-mode circuits;
current-mode logic;
multivalued logic;
multivalued logic circuits;
A/D converters;
Continuous Valued Number System;
D/A converters;
binary digit;
current-mode multiple-valued dynamic memory;
leakage current;
multiple-valued neural networks;
multiple-valued representation;
noise margin;
refreshing circuitry;
CVNS;
error correction;
memory;
multiple-valued;
42.
Robust Multiple-Valued Current-Mode Circuit Components Based on Adaptive Reference-Voltage Control
机译:
基于自适应参考电压控制的稳健多值电流模式电路元件
作者:
Onizawa N.
;
Hanyu T.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
CMOS logic circuits;
adaptive control;
current-mode logic;
multivalued logic circuits;
power supply circuits;
signal detection;
voltage control;
CMOS technology;
PMOS transistor;
adaptive reference-voltage control;
current source;
gate-source voltage;
logical threshold voltage;
power-supply circuit components;
power-supply-tolerant current source;
robust multiple-valued current-mode circuit components;
seven-level current-signal detector;
temperature-variation-aware circuit components;
Multiple-valued current-mod;
43.
Multiple-Valued Reconfigurable VLSI Processor Based on Superposition of Data and Control Signals
机译:
基于数据和控制信号叠加的多值可重构VLSI处理器
作者:
Okada N.
;
Kameyama M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
VLSI;
multiplexing;
multivalued logic;
reconfigurable architectures;
2-to-1 multiplexer;
VLSI processor;
arithmetic logic controllers;
arithmetic logic modules;
multiple-valued logic;
Digit-serial architecture;
Direct allocation;
FPGA;
Multiple-valued current-mode logic;
44.
Author Index
机译:
作者索引
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
45.
Publisher Information
机译:
发布者信息
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
46.
Mining Approximative Descriptions of Sets Using Rough Sets
机译:
使用粗糙集挖掘集合的近似描述
作者:
Simovici D.A.
;
Mimaroglu S.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
rough set theory;
approximative set descriptions mining;
apriori algorithm;
taxonomic units;
borders of sets;
rough sets;
47.
The Minimal Covering of Maximal Partial Clones in 4-valued Logic
机译:
四值逻辑中最大部分克隆的最小覆盖
作者:
Scholzel K.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
multivalued logic;
set theory;
4-valued Logic;
k-element set;
maximal partial clone;
minimal covering;
partial Sheffer function;
48.
Synthesis of GF(3) Based Reversible/Quantum Logic Circuits without Garbage Output
机译:
不含垃圾输出的基于GF(3)的可逆/量子逻辑电路的合成
作者:
Khan M.M.
;
Biswas A.K.
;
Chowdhury S.
;
Hasan M.
;
Khan A.I.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Galois fields;
logic circuits;
quantum gates;
Galois field sum of products;
Muthukrishnan-Stroud gates;
multi input ternary Toffoli gate;
quantum logic circuits;
reversible logic circuits;
square functions;
ternary Galois field;
Galois field sum of product (GFSOP);
Reversible/quantum computing;
Ternary Galois field (GF3);
ternary Toffoli gate;
trit;
49.
Generalized Discrete Hartley Transforms
机译:
广义离散Hartley变换
作者:
Moraga C.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Fourier transforms;
discrete Hartley transforms;
matrix algebra;
Fourier power spectrum;
Fourier transform;
complex-valued orthogonal transform;
discrete real-valued orthogonal transforms;
generalized discrete Hartley transforms;
pattern analysis;
picture processing;
real-valued Matrix;
Hartley transform;
even and odd patterns;
pattern spectra;
50.
Multi-valued Modal Fixed Point Logics for Model Checking
机译:
用于模型检查的多值模态不动点逻辑
作者:
Nishizawa K.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
formal verification;
multivalued logic;
temporal logic;
Kripke model;
modal fixed point logic;
model checking;
multi-valued logic;
Fixedpoint logic;
Modal Logic;
51.
Generating Hard Instances for MaxSAT
机译:
为MaxSAT生成硬实例
作者:
Bejar R.
;
Cabiscol A.
;
Manya F.
;
Planes J.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
computability;
MaxSAT solvers;
MaxkSAT instances;
scaling behavior;
benchmark;
maxsat;
practical complexity;
52.
Design of a High-Speed Fuzzy Logic Controller Based on Log-Domain Arithmetic
机译:
基于对数域算法的高速模糊逻辑控制器设计
作者:
Razib A.
;
Dick S.
;
Gaudet V.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
arithmetic;
control system synthesis;
fuzzy control;
fuzzy set theory;
step response;
defuzzification module optimization;
division operation;
high-speed fuzzy logic controller design;
log-domain arithmetic;
look-up table operation;
max/min operation;
multiplication operation;
second-order plant;
53.
Bounding the Phase Transition on Edge Matching Puzzles
机译:
在边缘匹配难题上限制相变
作者:
Bejar R.
;
Fernandez C.
;
Mateu C.
;
Pascual N.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
computational complexity;
edge detection;
optimisation;
NP-complete problems;
complex problem structure;
edge matching puzzles;
exact asymptotic behavior;
phase transition;
statistical measures;
complexity;
csp;
edge matching;
sat;
54.
Biometric System by Foot Pressure Change Based on Neural Network
机译:
基于神经网络的足压变化生物识别系统
作者:
Hong Ye
;
Kobashi S.
;
Hata Y.
;
Taniguchi K.
;
Asari K.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
biometrics (access control);
feature extraction;
neural nets;
pressure sensors;
biometrics personal identification system;
false rejection rate;
foot pressure change;
k-out-of-n system;
load distribution sensor;
neural network;
center of pressure;
foot pressure;
neural network biometrics;
55.
On Periodic Patterns and their Spectra
机译:
论周期模式及其谱
作者:
Moraga C.
;
Stankovic R.
;
Astola J.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Fourier transforms;
matrix algebra;
pattern recognition;
signal processing;
spectral analysis;
2D-Dirichlet kernel;
Fourier transform;
nonAbelian group;
orthogonal matrix;
2D-Spectra;
Periodicity;
pattern processing;
56.
On the Guidance of Reversible Logic Synthesis by Dynamic Variable Reordering
机译:
动态变量重排序对可逆逻辑综合的指导
作者:
Feinstein D.Y.
;
Thornton M.A.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
decision diagrams;
logic design;
multivalued logic circuits;
Miller-Maslov-Dueck algorithm;
binary reversible circuits;
complete function specification;
dynamic variable reordering;
quantum multiple-valued decision diagrams;
reversible logic synthesis;
MVL;
QMDD;
quantum logic;
reversible MVL synthesis;
reversible logic;
57.
Title Page i
机译:
标题页
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
58.
Efficient Implementation of Controlled Operations for Multivalued Quantum Logic
机译:
多值量子逻辑控制操作的有效实现
作者:
Rosenbaum D.
;
Perkowski M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
circuit complexity;
logic arrays;
mathematical operators;
multivalued logic;
quantum gates;
multivalued quantum logic gate;
quantum array;
single-qudit Hermitian operator;
single-qudit controlled gate;
Controlled;
Logic;
Multivalued;
Operation;
Quantum;
59.
Multi-level Signaling for Chip-to-Chip and Backplane Communication (A Tutorial)
机译:
芯片到芯片和背板通信的多级信令(教程)
作者:
Sheikholeslami A.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
analogue-digital conversion;
decision feedback equalisers;
equalisers;
frequency response;
intersymbol interference;
multivalued logic circuits;
ADC;
analogue-to-digital converter;
backplane communication;
binary signaling;
chip-to-chip communication;
decision feedback equalizer;
inter-symbol interference;
multi-level signaling;
signal attenuation;
signal quality;
DFE;
ISI;
backplane;
chip-to-chip;
crosstalk;
equalization;
60.
A Two-Pronged Approach of Power-Aware Voltage Scheduling for Real-Time Task Graphs in Multi-processor Systems
机译:
多处理器系统中实时任务图的功率感知电压调度的两种方法
作者:
Kamiura N.
;
Saitoh A.
;
Isokawa T.
;
Matsui N.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
multiprocessing systems;
power aware computing;
processor scheduling;
hard real-time multiprocessor system;
power-aware voltage scheduling;
real-time task graphs;
slack;
two-pronged approach;
energy saving;
hard realtime system;
multiple voltage levels;
task graph;
voltage-scheduling heuristic;
61.
Computational Neuroscience and Multiple-Valued Logic
机译:
计算神经科学与多值逻辑
作者:
Kawato M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
humanoid robots;
neural nets;
artificial brain;
brain functions computational models;
computational neuroscience;
humanoid robot;
multiple-valued logic;
62.
Fixed Polarity Quaternary Transforms Derived from Linearly Independent Transform over GF(2) Structure
机译:
从GF(2)结构上的线性独立变换得出的固定极性四元变换
作者:
Lozano C.C.
;
Falkowski B.J.
;
Luba T.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Galois fields;
transforms;
Galois field;
binary fixed polarity Reed-Muller transforms;
fast flow graph;
fixed polarity quaternary linearly independent transform;
recursive equations;
recursive quaternary linearly independent transforms;
63.
Multiple-Valued Logic Gates Using Asymmetric Single-Electron Transistors
机译:
使用非对称单电子晶体管的多值逻辑门
作者:
Wan-cheng Zhang
;
Nan-jian Wu
;
Hashizume T.
;
Kasai S.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
analogue-digital conversion;
logic gates;
low-power electronics;
multivalued logic circuits;
single electron transistors;
tunnelling;
Coulomb staircase characteristics;
MV analog-digital conversion circuits;
SET;
arbitrary radix-4 literal gate;
asymmetric single-electron transistors;
low-power dissipation;
multiple-valued logic gates;
tunneling junctions;
asymmetric;
literal gate;
multiple-valued logic;
single-electron transistor;
64.
On Decision Making under Interval Uncertainty: A New Justification of Hurwicz Optimism-Pessimism Approach and its Use in Group Decision Making
机译:
区间不确定性下的决策:Hurwicz乐观-悲观主义方法的新证明及其在群体决策中的应用
作者:
Van Nam Huynh
;
Nakamori Y.
;
Chenyi Hu
;
Kreinovich V.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
decision making;
minimax techniques;
statistical distributions;
uncertain systems;
Hurwicz optimism-pessimism approach;
group decision making;
interval uncertainty;
65.
Evaluation of Cardinality Constraints on SMT-Based Debugging
机译:
基于SMT调试的基数约束评估
作者:
Sulflow A.
;
Wille R.
;
Fey G.
;
Drechsler R.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
adders;
computability;
encoding;
formal verification;
logic testing;
rewriting systems;
SMT-based debugging;
abstraction technique;
adder network;
bit-blasting technique;
cardinality constraint;
hardware satisfiability modulo theory;
multiplexor;
shifter;
term-rewriting;
Satisfiable Modulo Theory (SMT);
debugging;
66.
Evaluation of the Hierarchical Temporal Memory as Soft Computing Platform and its VLSI Architecture
机译:
分层临时存储器作为软计算平台的评估及其VLSI架构
作者:
Melis W.J.C.
;
Chizuwa S.
;
Kameyama M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
VLSI;
belief networks;
domestic appliances;
home computing;
knowledge based systems;
Bayesian network;
VLSI architecture;
hierarchical temporal memory;
intention estimation information appliance system;
soft computing platform;
user support system;
probabilistic systems;
soft computing;
user support systems;
67.
Message from the Symposium Chair
机译:
研讨会主席致辞
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
68.
Floating-Point Numerical Function Generators Using EVMDDs for Monotone Elementary Functions
机译:
使用EVMDD用于单调基本函数的浮点数值函数生成器
作者:
Nagayama S.
;
Sasao T.
;
Butler J.T.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
decision diagrams;
floating point arithmetic;
floating-point numerical function generators;
monotone elementary functions;
multi-valued decision diagrams;
EVBDD;
EVMDD;
Mp-monotone increasing functions;
transition points;
69.
Non-convex Fuzzy Truth Values and De Morgan Bisemilattices
机译:
非凸模糊真值和De Morgan Bisemilattices
作者:
Takagi N.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
fuzzy logic;
fuzzy set theory;
lattice theory;
de Morgan Bisemilattices;
logic formula;
nonconvex fuzzy truth value;
Fuzzy truth values;
70.
Designing and Using FPGAs beyond Classical Binary Logic: Opportunities in Nano-Scale Integration Age
机译:
设计和使用超越经典二进制逻辑的FPGA:纳米级集成时代的机遇
作者:
Zilic Z.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
field programmable gate arrays;
integrated circuit design;
logic design;
multivalued logic;
nanoelectronics;
FPGA design;
classical binary logic;
emulation;
nanoscale integration;
Design tools;
FPGAs;
High Capacity Memories;
Multiple-valued logic;
Nanotechnology;
Verification;
71.
Clarifying the Systems of Axioms Based on the Method of Indeterminate Coefficients
机译:
基于不定系数法澄清公理系统
作者:
Ninomiya T.
;
Mukaidono M.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
Boolean algebra;
axiom systems;
finite models;
indeterminate coefficients;
B.Russell's logical axioms;
Kleene algebra;
the method of indeterminate coefficients;
72.
Multiple Valued Logic Algebra for the Synthesis of Digital Circuits
机译:
用于数字电路综合的多值逻辑代数
作者:
Romero M.E.R.
;
Martins E.M.
;
Santos R.R.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
algebra;
duality (mathematics);
logic design;
logic gates;
multivalued logic circuits;
network synthesis;
circuit simplification;
duality;
logic switching algebra;
multiple-valued logic digital circuit synthesis;
universal gate;
Digital Circuits;
MVL;
MVL Algebra;
Synthesis;
73.
Minimal Coverings of Maximal Partial Clones
机译:
最大部分克隆的最小覆盖
作者:
Scholzel K.
会议名称:
《Multiple-Valued Logic, 2009. ISMVL '09》
|
2009年
关键词:
functions;
matrix algebra;
k-element set;
maximal partial clones;
partial Sheffer function;
unique minimal covering;
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