机译:纳米CMOS触发器的能量延迟面积域中的分析和比较:第一部分—方法论和设计策略
Dipartimento di Ingegneria dell'Informazione, Universit?? di Siena, Siena, Italy;
Clocking; Logical Effort; VLSI; energy efficiency; energy-delay tradeoff; flip-flops (FFs); high speed; interconnects; leakage; low power; nanometer technologies;
机译:纳米CMOS触发器的能量延迟面积域中的分析和比较:第二部分—结果和优点图
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