FPGAでシリアルATAコントローラた設計する: 第4回 シリアルATAコアとシミュレーション

菅原　博英

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【24h】

FPGAでシリアルATAコントローラた設計する: 第4回シリアルATAコアとシミュレーション

机译：在FPGA中使用串行ATA控制器进行设计：第4个串行ATA内核和仿真

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コードの解説を読むだけでは，SATAの動作を理解するのはなかなか難しいと思います．今回はRTL設計に伴うシミュレーション環境を設計します．このうちのリンク層の確認を実行させます．まずPHYの初期化完了後，最初に送信されるRegD2Hを試してみます．

机译：我认为仅阅读代码说明很难理解SATA的操作。这次，我们将为RTL设计设计一个仿真环境。确认这些的链接层。首先，在完成PHY的初始化之后，尝试首先发送的RegD2H。

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来源
《インタ-フェ-ス》 |2008年第10期|p.193-195|共3页
作者
菅原　博英;
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作者单位

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收录信息
原文格式 PDF
正文语种 jpn
中图分类计算技术、计算机技术;
关键词
シリアルATAコア; リンク層; FIS転送; 8B/10B変換; スクランプラ;

机译：串行ATA内核;链路层;FIS传输;8B / 10B转换;Scrangler;

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