机译:设计多操作数模块化加法器
Dipartimento di Ingegneria dell'Inf., Pisa Univ.;
adders; logic design; residue number systems; carry-save adder tree; design; logarithmic time; multioperand modular adders; response time;
机译:使用进位保存加法器设计残差发生器和多操作数模块化加法器
机译:FPGA上的多操作数冗余加法器
机译:高速多操作数十进制加法器
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机译:模块化理解:用于在音频软件和硬件中设计模块化的分类法和工具包。
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机译:使用进位保存加法器设计残差发生器和多工作模块加法器