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张宗玉; 宋云娴; 乔凤兰;
海军航空工程学院青岛分院,青岛,266041;
空军工程大学工程学院,西安,710038;
数字逻辑电路设计 VHDL 硬件 描述语言 CPLD CAD;
机译:组装各个部分以从工作原理到设计方法进行理解-PLL频率合成器的设计方法的全面说明:第15号如何制作可在工作期间设置分频比的分频器-参考信号分频器和可编程组件周边制造
机译:组装各个部分以从工作原理到设计方法进行理解-PLL频率合成器的设计方法的详尽说明:第十六分频器,具有可以处理高频的精细频率步进-通过脉冲吞咽进行整数除法和分数除法原理
机译:2 x2分频器设计的一般相关系数类别
机译:具有半整数分频比步长的高能效多模可编程分频器
机译:具有整数分频器的高频应用的低功耗CMOS锁相回路频率合成器
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机译:基于1 / 1.5分频器单元的双模真正模块化可编程分数分频器
机译:分频器设计 - 计算机图形编排安排程序(COGap)用户/系统手册的扩展,
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机译:频率合成器使用分频器,低噪声的半整数和模拟增益补偿。
机译:低噪声,使用分频器和带半整数频率合成器的模拟增益补偿
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