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基于DDS+PLL技术的高频时钟发生器

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摘要

针对直接数字频率合成(DDS)和集成锁相环(PLL)技术的特性,提出了一种新的DDS激励PLL系统频率合成时钟发生器方案.分析了频率合成系统相位噪声和杂散抑制的方法,介绍了主要器件AD9854和ADF4106的性能.

著录项

来源
《现代电子技术》 |2004年第14期|1-3|共3页
作者
王轶; 朱江;
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作者单位

国防科技大学电子科学与工程学院,湖南,长沙,410073;

西安卫星测控中心陕西,西安,710043;

国防科技大学电子科学与工程学院,湖南,长沙,410073;

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原文格式 PDF
正文语种 chi
中图分类天线：按工作原理分;
关键词
直接数字频率合成; 锁相环; 相位噪声; 杂散抑制;

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