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李罗生; 侯朝焕;
中国科学院声学研究所;
北京;
100080;
随机激励 ; 模块化; 验证平台 ; 处理器 ;
机译:一个4路VLIW嵌入式多媒体处理器
机译:一个2.5-GFLOPS,每秒650万个多边形,具有SIMD指令和软件旁路机制的四向VLIW几何处理器
机译:一个2.5-GFLOPS,每秒650万个多边形,四路VLIWgeometry处理器,带有SIMD指令和软件旁路机制
机译:基于VLIW处理器的低功耗发射器和VLIW处理器的质量 - 能量可扩展OFDMA调制
机译:嵌入式VLIW处理器的互补编译器和体系结构功能。
机译:专为基于传感器的系统的VLIW DSP设计的高级编译器
机译:实时Zetta与VHDL和Verilog HDL为高容量数据计算处理器的实时Zetta字节 - 单位存储ASIC SOC IP核心设计实现,如云/群/超级VLIW并行分配流水线阵列计算处理器
机译:特温特大学多处理器(TUmULT)系统的调查,一个实时多处理器系统
机译:产生vliw指令的装置和方法以及vliw处理器和vliw指令的处理方法
机译:生成VLIW指令和VLIW处理器的装置和方法以及VLIW指令的处理方法
机译:VLIW型处理器的编译器以及开发VLIW型处理器程序的系统和方法
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