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超高速8×8阵列式乘法器的研制和测试

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摘要

以多元逻辑电路(DYL)中的线性逻辑门为核心,构思体现这种基本逻辑结构特长的高速阵列式乘法器的结构原理以及该器件的测试方法,并获得了乘法时间小于IOns的乘法器,达到了我们预期的目标.该电路可以直接与TTL电路兼容使用.

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来源
《微处理机》|2008年第2期|19-20|共2页
作者
刘汝刚; 孟菲;
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作者单位

中国电子科技集团公司第四十七研究所,沈阳,110032;

中国电子科技集团公司第四十七研究所,沈阳,110032;

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原文格式 PDF
正文语种 chi
中图分类微电子学、集成电路（IC）;
关键词
多元逻辑电路; 超高速; 乘法器; 测试;
入库时间 2023-07-25 18:37:53

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