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杨会玲; 唐彬; 王军;
苏州科技学院;
安徽理工大学;
STM32; FPGA; IRIG—B码; 时统解码;
机译:交错式里德-所罗门码与级联码设计的协同解码
机译:利用可重构处理器设计所罗门码解码电路的设计
机译:使用卷积码对单一时空码进行Turbo(迭代)解码
机译:关于时空码和组码的设计和快速解码算法。
机译:用于尾纹卷积码的加权维特比解码器的深组合
机译:低功耗RsC turbo码和迭代块解码器设计的VLsI电路复杂度和解码性能分析
机译:具有门限解码的几种卷积码和码码的性能
机译:纠错解码器的turbo码,turbo码的纠错解码方法,turbo码解码装置和turbo码解码系统
机译:Turbo码纠错解码器,turbo码纠错解码方法,turbo码解码装置以及turbo码解码系统
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