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HSDPA中F-HARQ技术的FPGA实现

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摘要

高速下行分组接入(HSDPA)技术是实现提高3G网络高速下行数据传输速率最为重要的技术,F-HARQ为其核心技术.在分析各种混合重传请求技术(HARQ)原理基础上,完成发送端F-HARQ硬件模块的设计及其Verilog实现,并通过FPGA仿真验证,结果表明所设计的硬件模块发送速率达到50MHz.

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来源
《微计算机信息》|2010年第14期|122-123,70|共3页
作者
黄振杰; 黄君凯;
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作者单位

510632,广州暨南大学电子工程系;

510632,广州暨南大学电子工程系;

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原文格式 PDF
正文语种 chi
中图分类 N915;
关键词
高速下行分组接入; 快速混合重传请求技术; FPGA;
入库时间 2023-07-24 16:33:42

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