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姜强; 谢军;
电子科技大学通信与信息工程学院;
高级加密标准; SubBytes; 现场可编程逻辑门阵列;
机译:FPGA的高度可扩展AES算法的FPGA实现,采用改进的混合列和门替换技术,用于TCP / IP中的安全性应用
机译:使用异步电路实现超低压操作的节能AES SubBytes转换电路
机译:使用SubBytes的内存表实现评估AES的功耗分析
机译:使用复合场算法实现AES算法的Compact S盒的FPGA实现
机译:128位AES算法的低功率FPGA实现
机译:FPGA上的OTSU自动图像阈值算法的完全平行实现
机译:Virtex-6 FPGA和MicroBlaze软核处理器中实现的AES和DES算法的比较
机译:基于FpGa的高效集群检测算法实现时间投影室偏振计中的条带检测器读出系统。
机译:AES Rijndael密码算法的硬件实现的AES Rijndael回合处理电路和在线回合密钥生成电路
机译:实现秘密密钥加密AES算法的电子组件中的对策方法
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