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基于CPLD的EPP并行接口设计

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摘要

详细介绍了一种在CPLD控制下实现的微型机EPP并行接口设计方案.CPLD的接口时序逻辑控制功能采用状态机工作方式实现,并给出了用VHDL编写的主要源代码.通过调试,该方案已成功应用于作者所开发的传感器数据采集系统,达到了良好的工程应用效果.

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来源
《网络新媒体技术》|2006年第2期|251-253|共3页
作者
李振杰; 刘宁宁; 米立红;
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作者单位

北京军区通信训练大队,北京,100093;

北京军区通信训练大队,北京,100093;

北京军区通信训练大队,北京,100093;

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原文格式 PDF
正文语种 chi
中图分类计算技术、计算机技术;
关键词
CPLD; EPP并口; VHDL;
入库时间 2023-07-25 20:03:02

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