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元泽怀;
肇庆学院,电子信息工程系,广东,肇庆,526061;
有限状态机; VHDL; 状态转换; 综合;
机译:硬件中的有限状态机:理论和设计(带有VHDL和System Verilog)
机译:基于VHDL的完全自检有限状态机设计及数据路径描述
机译:基于VHDL的完全自检有限状态机设计和数据路径描述
机译:基于VHDL的有限状态机的设计
机译:通信有限状态机的系统,作为有限状态机的分布式替代方案。
机译:基于PWL功能的多涡旋混沌振荡器的FPGA实现的VHDL描述
机译:构建紧凑的测试以对有限状态机的VHDL描述进行功能验证
机译:用实验设计开发小型无人机有限状态机。
机译:用于相位制动回路的异步分频器具有异步有限状态机,该异步有限状态机设计为在各个工作模式下循环通过稳定状态,其中稳定状态是其他稳定状态的子集
机译:有限状态机的设计验证装置,设计验证方法和设计验证程序
机译:有限状态机的设计验证装置,其设计验证方法及其设计验证程序
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