RTL综合中基本时序逻辑元件的综合方法研究

袁媛; 谢巍; 刘明业

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锁存器与触发器的综合是RTL综合中时序逻辑综合子系统的主要研究问题之一,不同的RTL时序电路描述综合出的元件各不相同.文中从VHDL语言的RTL描述特征入手,研究了RTL综合中锁存器与触发器的综合方法,阐述了采用锁存器及触发器的各种不同情况,同时说明如何才能正确地区分锁存器及触发器.文章最后的实验结果验证了该方法.

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来源
《计算机辅助设计与图形学学报》 |2001年第9期|855-859|共5页
作者
袁媛; 谢巍; 刘明业;
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作者单位

北京理工大学ASIC研究所;

北京理工大学ASIC研究所;

北京理工大学ASIC研究所;

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原文格式 PDF
正文语种 chi
中图分类 TP229;
关键词
RTL综合; VHDL描述; 格式判别; 锁存器; 触发器;

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