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张建妮;
西华师范大学物理与电子信息学院;
FPGA; 仿真; VHDL;
机译:具有扩展范围多模分频器的2.0–5.5 GHz宽带基于环的数字小数N PLL
机译:基于VEDIC乘法器和可逆逻辑门的基于FPGA的64位MAC单元的设计与实现
机译:基于FPGA芯片的基于GA的模糊系统的设计与实现
机译:基于重定时小数分频器的12 GHz全数字免校准FMCW信号发生器
机译:带有小数N分频器和3位量化器的Delta-Sigma鉴频器。
机译:基于FPGA的脉冲电子顺磁共振应用时序脉冲编程器的设计与实现
机译:采用FIR嵌入式分频器生成数字时钟的小数N分频pLL
机译:基于小数据集的串级系统可靠性点值与区间估计
机译:小数分频器,电视接收机,小数分频器以及视频信号集成电路的方法
机译:电子分频器电路由于不需要一级而得到了改进-具有小数点控制机制,该机制涉及带有小数和除数部分重计时数字的时钟小数点移位寄存器
机译:小数N分频器,小数N锁相环以及将输出信号的频率f除以N的方法,其中N是非整数
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