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一种用于低电源电压的全差分运算放大器

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摘要

介绍一种适于数字CMOS工艺实现的全差分运算放大器的设计.该放大器用于电源电压为3V,分辩率为10位,采样频率为40MHz的流水线结构AD的采样保持和级间增益电路中.该放大器的结构为折叠-级联结构,在0.35μmCMOS工艺中带宽为162MHz,开环增益为73dB,功耗为1.92mW.

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来源
《电子与封装》 |2004年第4期|54-56|共3页
作者
何茗; 陈仕建;
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作者单位

电子机械高等专科学校电气系,四川,成都,610031;

电子机械高等专科学校电气系,四川,成都,610031;

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原文格式 PDF
正文语种 chi
中图分类 TN722.5+7;
关键词
运算放大器; 全差分; 流水线; 折叠-级联;

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