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段可博; 贾建援; 王卫东;
西安电子科技大学机电工程学院;
嵌入式CPU; 外围接口电路; CPLD; 数据总线; 译码单元; 分频电路; 逻辑电路; 可编程逻辑器件; 雷达; 伺服系统;
机译:第7章将CSIDE和F-Sight用于软CPU内核:带有FPGA及其外围电路的CPU调试方法
机译:具有基于“微控制器-CPLD”的共享存储器接口的异构嵌入式系统,用于传感器应用
机译:CPLD和外围电路设计的基础知识
机译:使用CPLD实现DSP与外围芯片之间的速度匹配电路设计
机译:摩托罗拉68HC12串行外围接口的可靠协议的设计和实现。
机译:RFID标签或其他无电池嵌入式设备的射频供电电路的设计与实现
机译:基于CPLD的环境检测仪器外围接口电路设计
机译:嵌入式图像中stegano图形技术的实现和效率以及有损压缩方案的嵌入式数据生存性
机译:用于为具有多个网络接口的过载CPU实现虚拟垂直外围框架的计算机体系结构和过程
机译:包括CPU和外围电路的半导体装置,其中控制单元执行等待周期控制,该等待周期控制使外围电路在响应于CPU之前等待预定时间
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