一种基于FPGA的抢答器设计

严世胜; 钟承尧

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介绍一种基于FPGA的抢答器设计,给出了顶层电路原理图和主模块的部分VHDL源程序.利用MAX+PLUSⅡ开发平台完成了编译、仿真,并下载到EPF10K10LC8404器件中进行测试.该抢答器不仅能实现互锁、自锁和倒计时功能,而且能用声音、数码管准确提示抢答的优先结果和犯规情况,具有广泛的应用前景.

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来源
《电脑与电信》 |2009年第11期|31-33|共3页
作者
严世胜; 钟承尧;
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作者单位

海南师范大学物理与电子工程学院,海南,海口,571158;

海南师范大学物理与电子工程学院,海南,海口,571158;

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正文语种 chi
中图分类计算技术、计算机技术;
关键词
抢答器; FPGA; VHDL; 仿真;

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