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雷轩; 卢超;
陕西理工学院物电学院;
陕西汉中723001;
异步时序逻辑电路; 分析和设计; 系统框图; 方法;
机译:异步时序逻辑电路中的故障影响
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机译:用于逻辑电路的时序约束生成方法,用于逻辑电路的时序生成约束程序以及用于将逻辑电路的时序生成约束的程序记录介质
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机译:逻辑电路的时序约束生成系统以及逻辑电路的时序约束生成方法,控制程序和可读记录介质
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