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林伟建; 王伦耀; 夏银水;
宁波大学信息科学与工程学院;
浙江宁波315211;
Reed-Muller逻辑; 有限状态机; 遗传算法; 逻辑综合; 双逻辑; 位操作;
机译:沟通有限状态机,一阶逻辑和无星际命题动态逻辑
机译:用于延迟和面积优化的基于CNFET的VLSI电路的逻辑努力框架
机译:基于优化GDI逻辑的NOR门和半加法器集成到PASTA中,以实现低功耗和小面积应用
机译:使用NSGA-II的同步有限状态机的状态分配中的双标准优化
机译:基于有限状态机的随机计算的分析,设计和逻辑综合。
机译:采用基本IGZO的MOS晶体管以减小的占位面积实现所有基本逻辑门的底栅方法
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机译:面积减小的双极集成注入逻辑单元-在隔离的逻辑单元下方使用掩埋的PNP晶体管保持逻辑速度,并在操作员输出端具有肖特基二极管
机译:集成电路的逻辑门尺寸优化过程,从而提高了电路速度,同时优化了电路面积
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