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吴庆; 汪小燕; 王芙蓉; 余毅敏;
华中科技大学电子与信息工程系金鹏华中研究所;
武汉;
430074;
HLR Cache机制 双数据库模式 SLRU替换算法;
机译:基于列表的缓存替换算法家族的瞬态和稳态机制
机译:Sarcopenia和Cachexia的分子机制:最近的研究进展
机译:复制HLR中的同步问题 - HLR审计工具
机译:CacheLight:防止恶意使用缓存锁定机制的轻量级方法
机译:covid-19相关的cachexia模仿癌症相关的cachexia吗?检查机制临床生物标志物和临床管理潜在目标
机译:稳态条件下WEB-pROXY CaCHE替换算法的分析*
机译:可伸缩多处理器中Cache-miss-Initiated预取技术的初步评估。
机译:具有选择性数据存储功能的处理器,既可以作为VICTIM CACHE,也可以作为数据存储或加速器存储器使用,并且在较低级别的CACHE中具有VICTIM CACHE标签
机译:多线程处理器中共享分区缓存中的每个线程CACHELINE分配机制
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