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高献伟; 靳济方; 方勇; 李为民;
北京电子科技学院;
北京;
100070;
有限域 乘法器 FPGA VHDL;
机译:未定义的控制序列lparGF(2m)上的位并行脉动乘法器,用于不可简化的三项式,具有ASIC和FPGA实现
机译:低寄存器收缩期全多项式GF(2m)的FPGA实现及其在三项式乘法器中的应用
机译:有限域GF(2m)的降低复杂度的多项式乘法器体系结构
机译:用于基于配对的密码系统的GF(2 / sup 2M /)乘法器的FPGA实现
机译:用于多项式GF(2m)乘法的PPR脉动阵列结构的VHDL实现。
机译:基于急诊科(ED)的快速设计与实现艾滋病筛查计划
机译:低寄存器收缩式全一阶多项式乘法器在\ u3ci \ u3eGF \ u3c / i \ u3e(2 \ u3csup \ u3em \ u3c / sup \ u3e)上的FPGA实现及其在三项式乘法器中的应用
机译:在基于sRam的FpGa TmR设计中实现冗余与奇异时钟域的易感性。
机译:椭圆曲线密码学的统一整数/伽罗瓦域(2m)乘法器体系结构
机译:用于GF(2M)中的混合乘法器的设备及其方法
机译:数字乘法器的电路装置-组件,用于处理二进制数,以及gf(2m)的元素
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