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王争; 刘佩林;
上海交通大学图像通信与信息处理研究所;
上海;
200030;
AVS视频标准; 帧内预测 ; 解码 ; Verilog ; HDL ;
机译:使用单个MAP解码器的低延迟Turbo解码器的并发算法和硬件实现
机译:H.264 / AVC硬件解码器的帧内预测模块
机译:用于H.264 / AVC编解码器的帧内预测发生器的新型硬件体系结构
机译:AV1编解码器的DC / CFL帧内预测解码器的硬件设计
机译:流水线Turbo解码器的硬件实现。
机译:一种新颖的硬件 - 软件协同设计和实现的猪算法
机译:使用重新排序逻辑(FpGa)实现aVs视频解码器:硬件级实现
机译:BCH编码器,解码器和接口的硬件实现
机译:通过创建单独的算法和硬件模块(其中算法模块控制硬件模块)来模拟集成电路的方法,其中由特定的硬件体系结构实现给定算法
机译:在数字硬件中有效实现安全哈希算法(SHA-1)的系统和方法,使用最少的硬件资源即可实现最佳计算速度
机译:用于信息存储的M u00ecdia,使用文档标记和音频数据显示交互式图像的方法以及 /或v u00ecdeo(AV)用于在交互式模式下处理文档标记的方法和设备。标记模式的文档源和图像音频源以及交互模式下的AV数据的v音频。该设备使用文档以交互模式处理音频和v / uvecdeo(AV)的数据标记,在计算机上用操作指令编码的指令编码的M u00ecdia通过 u00ecvel读取,以实现使用文档标记和交互显示图像的方法在计算机中读取音频数据和v u00ecdiao(AV)M u00ecdia通过用操作指令编码以实现以交互模式处理文档标记的方法。在计算机系统和方法中,使用文档标记以交互模式处理音频数据v u00ecdeo(AV)
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