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基于FPGA的IPv6精简协议栈的设计

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研究了LPv6精简协议栈的FPGA硬件实现,分析了各个模块的功能.编写了硬件结构的Verilog HDL模型,进行了仿真和逻辑综合.并成功用ALTERA的FGPA对协议栈进行了验证.仿真和实验结果证明,所设计的硬件达到了设计要求,使小设备接入网络更加方便快捷.

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来源
《计算机工程与应用》 |2008年第28期|113-115|共3页
作者
许川佩; 郝锐;
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作者单位

桂林电子科技大学;

电子工程学院;

广西;

桂林;

541004;

桂林电子科技大学;

电子工程学院;

广西;

桂林;

541004;

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原文格式 PDF
正文语种 chi
中图分类通信网;
关键词
现场可编程门阵列; IPv6; 协议栈; Vefilog HDL;

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