读写数据宽度不同的异步FIFO设计

王纲毅; 王振华; 田金文; 柳健

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读写数据宽度不同的异步FIFO设计

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提出并实现了具有总线功能的异步FIFO,即写入字宽和读出字宽不同的高速异步FIFO设计.此FIFO基于Altera公司的Stratix系列FPGA实现,达到了高于200Mhz的工作频率,采用verilog语言设计,通过对设计进行简单的修改,即可应用于各种不同的系统的设计,给很多带宽不匹配的系统提供了一种简单的解决方案.

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来源
《计算机与数字工程》 |2005年第6期|107-110|共4页
作者
王纲毅; 王振华; 田金文; 柳健;
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作者单位

华中科技大学电子与信息工程系图像中心;

武汉;

430074;

华中科技大学电子与信息工程系图像中心;

武汉;

430074;

华中科技大学电子与信息工程系图像中心;

武汉;

430074;

华中科技大学电子与信息工程系图像中心;

武汉;

430074;

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原文格式 PDF
正文语种 chi
中图分类总线、通道;
关键词
FPGA; 异步; FIFO; 格雷码; Verilog; 总线匹配;

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