CMOS logic circuits; logic gates; leakage currents; logic design; threshold logic; transistors; low-power electronics; leakage reduction; CMOS circuits; complementary metal oxide semiconductor; self controlled stacked transistors; threshold voltage; static power dissipation; CMOS gates; subthreshold leakage current; leakage control transistors; logic gate; cut off voltage; benchmark circuits;
机译:强制堆栈睡眠晶体管(Fortran):基于CMOS的电路设计中的一种新的漏电流减少方法
机译:利用泄漏控制晶体管和多阈值CMOS技术设计低功耗CMOS电路
机译:减少串联/并联PMOS / NMOS晶体管堆栈中漏电流的新电路技术
机译:使用自控堆叠晶体管进行CMOS电路泄漏的新技术
机译:纳米级CMOS电路中减少泄漏技术的性能折衷。
机译:基于光纤的单壁碳纳米管晶体管电路对类似CMOS电路的稳定逻辑操作
机译:考虑晶体管堆栈精确建模的CmOs电路待机漏电功率估算