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Half-Swing Clocking Scheme for 75 Power Saving in Clocking Circuitry

机译：半摆时钟方案可节省时钟电路中75％的功耗

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来源
《》|2001年|P.23-24|共2页
会议地点
作者
Kojima; H.; Tanaka; S.;
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正文语种
中图分类无线电电子学、电信技术;
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1. Half-swing clocking scheme for 75% power saving in clocking circuitry [J] . Kojima H., Tanaka S. IEEE Journal of Solid-State Circuits . 1995,第4期

机译：半摆时钟方案可节省时钟电路75％的功耗
2. Half-Swing Clocking Scheme for 75% Power Saving in Clocking Circuitry [J] . Hirotsugu Kojima, Satoshi Tanaka, Katsuro Sasaki IEICE Transactions on Electronics . 1995,第6期

机译：半摆时钟方案可节省时钟电路75％的功耗
3. Power Saving in CMOS Using a Half-Swing Clock Scheme [J] . Deepti Kachhara, Rajendra Prasad, Ruchi Agarwal, International Journal of Engineering Research and Applications . 2012,第2期

机译：使用半摆时钟方案在CMOS中节省功耗
4. Half-Swing Clocking Scheme for 75 Power Saving in Clocking Circuitry [C] . Kojima H., Tanaka S., Institute of Electric and Electronic Engineer Symposium on VLSI Circuits . 2001

机译：半挥杆时钟方案75％省电时钟电路
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