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张斌; 张东来; 王超;
哈尔滨工业大学,深圳研究生院,广东,深圳,518055;
IRIG-B(DC)码; FPGA; 同步; 解码;
机译:IRIG-B时间码解码器的设计
机译:基于FPGA的IRIG-B(AC)编码器设计(英文)
机译:基于多数逻辑码的高数据速率Turbo解码器的VHDL设计和FPGA实现
机译:通过考虑不同的输入格式,基于FPGA的IRIG-B解码器可在PMU中实现同步
机译:低层准循环IRA码及其FPGA解码器的设计。
机译:EDSSA:基于OpenCL的FPGA平台上的编码器 - 解码器语义分段网络加速器
机译:基于SOPC的IRIG-B码编码器设计
机译:基于原型设计和基于FpGa的map同步器,适用于极高速率的FQpsK
机译:将同步FPGA设计转换为异步FPGA设计
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