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许浩博; 王颖; 王郁杰; 张士长; 刘博生; 韩银和;
中国科学院计算技术研究所 北京100190;
中国科学院大学 北京100190;
深度可分离(DS)卷积; 加速器; 低面积; 低延迟; 利用率;
机译:在FPGA上设计高效加速器的深度可分离卷积神经网络
机译:基于深度扩张可分离卷积的轻质和高效的深卷积神经网络
机译:用于深度卷积神经网络的低功耗和移动硬件加速器
机译:深度可分离卷积单元设计的低功耗硬件架构
机译:共同设计模型压缩算法和高效深度学习的硬件加速器
机译:兼容CUDA的GPU卡可作为Smith-Waterman序列比对的高效硬件加速器
机译:使用深度可分离卷积FPGA上的CNN加速器
机译:pOOsL的语义:面向对象的硬件/软件系统分析和设计规范语言
机译:高效卷积处理的硬件加速器
机译:硬件高效的深度卷积神经网络
机译:卷积硬件加速器的自适应选择与设计方法
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